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參數(shù)資料
| 型號： | LMK04002BEVAL |
| 廠商： | National Semiconductor |
| 文件頁數(shù)： | 27/65頁 |
| 文件大?。?/td> | 0K |
| 描述： | BOARD EVAL PRECISION CLOCK PLL |
| 標(biāo)準(zhǔn)包裝： | 1 |
| 系列： | PowerWise® |
| 主要目的： | 計時，時鐘調(diào)節(jié)器 |
| 嵌入式： | 否 |
| 已用 IC / 零件： | LMK04002 |
| 主要屬性： | 122.88 MHz VCXO |
| 次要屬性： | 集成式 PLL 和 VCO |
| 已供物品： | 板，線纜 |
| 產(chǎn)品目錄頁面： | 1275 (CN2011-ZH PDF) |
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SNOSAZ8J – SEPTEMBER 2008 – REVISED SEPTEMBER 2011
CLKoutX_DLY: Clock Channel Phase Delay Adjustment
Each output channel has an output delay register that can be used to introduce a lag relative to the distribution
path frequency (VCO Divider output). These registers support a 150 ps stepsize and range from 0 to 2.25 ns of
total delay. When the channel phase delay registers are enabled, a nominal fixed delay of 300 ps of delay is
incurred in addition to the programmed delay. The Channel Phase Delay Adjustment Registers are 4 bits wide
and are programmed as follows:
Table 7. CLKoutX_DLY: Clock Channel Delay Control Bit Values
CLKoutX_DLY [ 3:0 ]
DELAY (ps)
b3
b2
b1
b0
0
1
150
0
1
0
300
0
1
450
0
1
0
600
0
1
0
1
750
0
1
0
900
0
1
1050
1
0
1200
1
0
1
1350
1
0
1
0
1500
1
0
1
1650
1
0
1800
1
0
1
1950
1
0
2100
1
2250
CLKoutX/CLKoutX* LVCMOS Mode Control
For clock outputs that are configured as LVCMOS, the LVCMOS CLKoutX/CLKoutX* outputs can be
independently configured by uWire CLKoutXA_STATE and CLKoutXB_STATE bits. The following choices are
available for LVCMOS outputs:
Table 8. CLKoutXA_STATE, CLKoutXB_STATE Control Bits for LVCMOS Modes
CLKoutXA_STATE
CLKoutXB_STATE
LVCMOS Modes
b1
b0
b1
b0
0
Inverted
0
1
0
1
Normal
1
0
1
0
Low
1
TRI-STATE
CLKoutX/CLKoutX* LVPECL Mode Control
Clock outputs designated as LVPECL can be configured in one of two possible output levels. The default mode
is the common LVPECL swing of 800 mVp-p single-ended (1.6 Vp-p differential). A second mode, 2VPECL, can
be enabled in which the swing is increased to 1000 mVp-p single-ended (2 Vp-p differential).
Table 9. LVPECL Output Format Control
CLKoutX_PECL_LVL
Output Format
0
LVPECL (800 mVpp)
1
2VPECL (1000 mVpp)
Copyright 2008–2011, Texas Instruments Incorporated
33
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| 0210491025 | CABLE JUMPER 1.25MM .229M 31POS |
| MAX6063BEUR-T | IC VREF SERIES PREC 3V SOT-23-3 |
| V375B5E150BG2 | CONVERTER MOD DC/DC 5V 150W |
| GEM28DRMT-S288 | CONN EDGECARD 56POS .156 EXTEND |
| 234A061-3/42-0 | BOOT MOLDED |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| LMK04002BEVAL/NOPB | 功能描述:BOARD EVAL FOR LMK04002B RoHS:是 類別:編程器，開發(fā)系統(tǒng) >> 評估演示板和套件 系列:PowerWise® 標(biāo)準(zhǔn)包裝:1 系列:- 主要目的:數(shù)字電位器 嵌入式:- 已用 IC / 零件:AD5258 主要屬性:- 次要屬性:- 已供物品:板 相關(guān)產(chǎn)品:AD5258BRMZ1-ND - IC POT DGTL I2C1K 64P 10MSOPAD5258BRMZ10-ND - IC POT DGTL I2C 10K 64P 10MSOPAD5258BRMZ100-ND - IC POT DGTL I2C 100K 64P 10MSOPAD5258BRMZ50-ND - IC POT DGTL I2C 50K 64P 10MSOPAD5258BRMZ1-R7-ND - IC POT DGTL I2C 1K 64P 10MSOPAD5258BRMZ10-R7-ND - IC POT DGTL I2C 10K 64P 10MSOPAD5258BRMZ50-R7-ND - IC POT DGTL I2C 50K 64P 10MSOPAD5258BRMZ100-R7-ND - IC POT DGTL I2C 100K 64P 10MSOP |
| LMK04002BISQ | 制造商:NSC 制造商全稱:National Semiconductor 功能描述:Low-Noise Clock Jitter Cleaner with Cascaded PLLs |
| LMK04002BISQ/NOPB | 功能描述:時鐘合成器/抖動清除器 RoHS:否 制造商:Skyworks Solutions, Inc. 輸出端數(shù)量: 輸出電平: 最大輸出頻率: 輸入電平: 最大輸入頻率:6.1 GHz 電源電壓-最大:3.3 V 電源電壓-最小:2.7 V 封裝 / 箱體:TSSOP-28 封裝:Reel |
| LMK04002BISQE | 制造商:Texas Instruments 功能描述:Clock Conditioner 48-Pin LLP EP T/R |
| LMK04002BISQE/NOPB | 功能描述:時鐘合成器/抖動清除器 RoHS:否 制造商:Skyworks Solutions, Inc. 輸出端數(shù)量: 輸出電平: 最大輸出頻率: 輸入電平: 最大輸入頻率:6.1 GHz 電源電壓-最大:3.3 V 電源電壓-最小:2.7 V 封裝 / 箱體:TSSOP-28 封裝:Reel |
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