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參數(shù)資料
| 型號： | LC4384x |
| 廠商： | Lattice Semiconductor Corporation |
| 英文描述： | 3.3V/2.5V/1.8V In-System Programmable SuperFAST High density PDLs |
| 中文描述： | 3.3V/2.5V/1.8V在系統(tǒng)可編程超快高密度PDLs |
| 文件頁數(shù)： | 39/91頁 |
| 文件大?。?/td> | 851K |
| 代理商： | LC4384X |
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Lattice Semiconductor
ispMACH 4000V/B/C/Z Family Data Sheet
39
Boundary Scan Waveforms and Timing Speci
fi
cations
Symbol
Parameter
Min.
Max.
Units
t
BTCP
t
BTCH
t
BTCL
t
BTSU
t
BTH
t
BRF
t
BTCO
t
BTOZ
t
BTVO
t
BTCPSU
t
BTCPH
t
BTUCO
t
BTUOZ
t
BTUOV
TCK [BSCAN test] clock cycle
40
—
ns
TCK [BSCAN test] pulse width high
20
—
ns
TCK [BSCAN test] pulse width low
20
—
ns
TCK [BSCAN test] setup time
8
—
ns
TCK [BSCAN test] hold time
10
—
ns
TCK [BSCAN test] rise and fall time
50
—
mV/ns
TAP controller falling edge of clock to valid output
—
10
ns
TAP controller falling edge of clock to data output disable
—
10
ns
TAP controller falling edge of clock to data output enable
—
10
ns
BSCAN test Capture register setup time
8
—
ns
BSCAN test Capture register hold time
10
—
ns
BSCAN test Update reg, falling edge of clock to valid output
—
25
ns
BSCAN test Update reg, falling edge of clock to output disable
—
25
ns
BSCAN test Update reg, falling edge of clock to output enable
—
25
ns
相關PDF資料 |
PDF描述 |
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