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參數(shù)資料
| 型號(hào)： | LC4384x |
| 廠商： | Lattice Semiconductor Corporation |
| 英文描述： | 3.3V/2.5V/1.8V In-System Programmable SuperFAST High density PDLs |
| 中文描述： | 3.3V/2.5V/1.8V在系統(tǒng)可編程超快高密度PDLs |
| 文件頁(yè)數(shù)： | 38/91頁(yè) |
| 文件大小： | 851K |
| 代理商： | LC4384X |
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Lattice Semiconductor
ispMACH 4000V/B/C/Z Family Data Sheet
38
ispMACH 4000Z Timing Adders (Cont.)
1
Adder
Type
Base
Parameter
Description
-45
-5
-75
Units
Min.
Max.
Min.
Max.
Min.
Max.
Optional Delay Adders
t
INDIO
t
EXP
t
INREG
t
MCELL
Input register delay
—
1.30
—
1.30
—
1.30
ns
Product term expander
delay
—
0.45
—
0.45
—
0.50
ns
t
ORP
—
Output routing pool
delay
—
0.40
—
0.40
—
0.40
ns
t
BLA
t
ROUTE
Additional block load-
ing adder
—
0.05
—
0.05
—
0.05
ns
t
IOI
Input Adjusters
LVTTL_in
t
IN,
t
GCLK_IN,
t
GOE
t
IN,
t
GCLK_IN,
t
GOE
Using LVTTL standard
—
0.60
—
0.60
—
0.60
ns
LVCMOS33_in
Using LVCMOS 3.3
standard
—
0.60
—
0.60
—
0.60
ns
LVCMOS25_in
t
IN,
t
GCLK_IN,
t
GOE
Using LVCMOS 2.5
standard
—
0.60
—
0.60
—
0.60
ns
LVCMOS18_in
t
IN,
t
GCLK_IN,
t
GOE
Using LVCMOS 1.8
standard
—
0.00
—
0.00
—
0.00
ns
PCI_in
t
IN,
t
GCLK_IN,
t
GOE
Using PCI compatible
input
—
0.60
—
0.60
—
0.60
ns
t
IOO
Output Adjusters
LVTTL_out
t
BUF,
t
EN,
t
DIS
Output con
fi
gured as
TTL buffer
—
0.20
—
0.20
—
0.20
ns
LVCMOS33_out
t
BUF,
t
EN,
t
DIS
Output con
fi
gured as
3.3V buffer
—
0.20
—
0.20
—
0.20
ns
LVCMOS25_out
t
BUF,
t
EN,
t
DIS
Output con
fi
gured as
2.5V buffer
—
0.10
—
0.10
—
0.10
ns
LVCMOS18_out
t
BUF,
t
EN,
t
DIS
Output con
fi
gured as
1.8V buffer
—
0.00
—
0.00
—
0.00
ns
PCI_out
t
BUF,
t
EN,
t
DIS
Output con
fi
gured as
PCI compatible buffer
—
0.20
—
0.20
—
0.20
ns
Slow Slew
t
BUF,
t
EN
Output con
fi
gured for
slow slew rate
—
1.00
—
1.00
—
1.00
ns
Note: Open drain timing is the same as corresponding LVCMOS timing.
1. Refer to Technical Note TN 1004,
ispMACH 4000 Timing Model Design and Usage Guidelines
for information regarding use of these
adders.
Timing v.2.2
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