參數(shù)資料
型號: IDT82V3255TFG8
廠商: IDT, Integrated Device Technology Inc
文件頁數(shù): 80/132頁
文件大?。?/td> 0K
描述: IC PLL WAN SMC STRATUM 3 64-TQFP
標準包裝: 1,250
類型: 時鐘/頻率發(fā)生器,多路復(fù)用器
PLL:
主要目的: 以太網(wǎng),SONET/SDH,Stratum
輸入: CMOS,LVDS,PECL
輸出: CMOS,LVDS,PECL
電路數(shù): 1
比率 - 輸入:輸出: 3:3
差分 - 輸入:輸出: 是/是
頻率 - 最大: 622.08MHz
電源電壓: 3 V ~ 3.6 V
工作溫度: -40°C ~ 85°C
安裝類型: 表面貼裝
封裝/外殼: 64-LQFP
供應(yīng)商設(shè)備封裝: 64-TQFP(10x10)
包裝: 帶卷 (TR)
其它名稱: 82V3255TFG8
IDT82V3255
WAN PLL
Programming Information
51
December 3, 2008
6.2
REGISTER DESCRIPTION
6.2.1
GLOBAL CONTROL REGISTERS
ID[7:0] - Device ID 1
ID[15:8] - Device ID 2
73
---
--
OUT2_INV
-
74
IN_2K_4K_
8K_INV
8K_EN
2K_EN
2K_8K_PU
L_POSITI
ON
8K_INV
8K_PUL
2K_INV
2K_PUL
PBO & Phase Offset Control Registers
78
IN_NOISE
_WINDOW
-
PH_MON_
EN
PH_MON_
PBO_EN
PH_TR_MON_LIMT[3:0]
7A
PH_OFFSET[7:0]
7B
PH_OFFS
ET_EN
--
---
PH_OFFSET[9:8]
Synchronization Configuration Registers
7C
SYNC_BY
PASS
SYNC_MON_LIMT[2:0]
-
7D
-
SYNC_PH3[1:0]
SYNC_PH2[1:0]
SYNC_PH1[1:0]
Table 34: Register List and Map (Continued)
Address
(Hex)
Register Name
Bit 7
Bit 6
Bit 5
Bit 4
Bit 3
Bit 2
Bit 1
Bit 0
Reference
Page
Address: 00H
Type: Read
Default Value: 10001000
Bit
Name
Description
7 - 0
ID[7:0]
Refer to the description of the ID[15:8] bits (b7~0, 01H).
Address: 01H
Type: Read
Default Value: 00010001
Bit
Description
7 - 0
The value in the ID[15:0] bits are pre-set, representing the identification number for the IDT82V3255.
765
432
1
0
ID7
ID6
ID5
ID4
ID3
ID2
ID1
ID0
432
1
0
ID15
ID14
ID13
ID12
ID11
ID10
ID9
ID8
相關(guān)PDF資料
PDF描述
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IDT82V3280APFG8 制造商:Integrated Device Technology Inc 功能描述:IC PLL WAN SE STRATUM 2 100TQFP