IDT / ICS FREQUENCY GENERATOR/JITTER ATTE" />
參數(shù)資料
型號: ICS813076CYILFT
廠商: IDT, Integrated Device Technology Inc
文件頁數(shù): 19/23頁
文件大?。?/td> 0K
描述: IC VCXO-PLL WIRELESS 64-TQFP
標準包裝: 500
系列: HiPerClockS™, FemtoClock™
類型: 時鐘/頻率發(fā)生器,扇出緩沖器(分配),抖動衰減器,多路復用器
PLL:
主要目的: 無線基礎架構應用
輸入: HCSL,LVDS,LVHSTL,LVPECL,SSTL,晶體
輸出: LVPECL
電路數(shù): 1
比率 - 輸入:輸出: 3:9
差分 - 輸入:輸出: 是/是
頻率 - 最大: 614.4MHz
電源電壓: 3.135 V ~ 3.465 V
工作溫度: -40°C ~ 85°C
安裝類型: 表面貼裝
封裝/外殼: 64-TQFP 裸露焊盤
供應商設備封裝: 64-TQFP-EP(10x10)
包裝: 帶卷 (TR)
其它名稱: 813076CYILFT
IDT / ICS FREQUENCY GENERATOR/JITTER ATTENUATION
5
ICS813076CYI REV. A JULY 8, 2008
ICS813076I
FREQUENCY GENERATOR/JITTER ATTENUATION FOR WIRELESS INFRASTRUCTURE
TABLE 3B. VCXO PRE-DIVIDER (P) CONFIGURATION TABLE
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TABLE 3C. VCXO MULTIPLIER (MV-DIVIDER) CONFIGURATION TABLE
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The VCXO pre-divider (P) down-scales the input reference
frequency f
REF and enables the use of the ICS813076I at a variety
of input frequencies. P_SEL and MV_SEL must be set to match
the VCXO frequency: f
REF ÷ P = fVCXO ÷ MV. For instance, at the
nominal VCXO frequency of 30.72MHz and if MV equals two, the
input frequency must be an integer multiple of 15.36MHz.
TABLE 3F. PLL OUTPUT-DIVIDER (NA, NB, NC) CONFIGURATION TABLE
TABLE 3E. INPUT REFERENCE CLOCK MULTIPLEXER
CONFIGURATION TABLE
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TABLE 3D. FEMTOCLOCK FEEDBACK DIVIDER (MF)
CONFIGURATION TABLE
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PDF描述
ICS841S012DKILFT IC FREQ SYNTHESIZER 56VFQFN
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