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參數(shù)資料
| 型號： | ICS813076CYILFT |
| 廠商： | IDT, Integrated Device Technology Inc |
| 文件頁數(shù)： | 18/23頁 |
| 文件大小： | 0K |
| 描述： | IC VCXO-PLL WIRELESS 64-TQFP |
| 標(biāo)準(zhǔn)包裝： | 500 |
| 系列： | HiPerClockS™, FemtoClock™ |
| 類型： | 時(shí)鐘/頻率發(fā)生器，扇出緩沖器（分配），抖動(dòng)衰減器，多路復(fù)用器 |
| PLL： | 是 |
| 主要目的： | 無線基礎(chǔ)架構(gòu)應(yīng)用 |
| 輸入： | HCSL，LVDS，LVHSTL，LVPECL，SSTL，晶體 |
| 輸出： | LVPECL |
| 電路數(shù)： | 1 |
| 比率 - 輸入:輸出： | 3:9 |
| 差分 - 輸入:輸出： | 是/是 |
| 頻率 - 最大： | 614.4MHz |
| 電源電壓： | 3.135 V ~ 3.465 V |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 64-TQFP 裸露焊盤 |
| 供應(yīng)商設(shè)備封裝： | 64-TQFP-EP（10x10） |
| 包裝： | 帶卷 (TR) |
| 其它名稱： | 813076CYILFT |
IDT / ICS FREQUENCY GENERATOR/JITTER ATTENUATION
4
ICS813076CYI REV. A JULY 8, 2008
ICS813076I
FREQUENCY GENERATOR/JITTER ATTENUATION FOR WIRELESS INFRASTRUCTURE
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TABLE 3A. FREQUENCY CONFIGURATION EXAMPLES TABLE (f
VCXO = 30.72MH
Z
)
DEVICE CONFIGURATION
The ICS813076I is a two stage device, a VCXO PLL stage
followed by a low phase noise FemtoClock PLL multiplier stage.
The VCXO PLL stage uses a pullable crystal to lock to the
reference clock. The low phase noise FemtoClock multiplies
the VCXO PLL output clock up to 614.4MHz and three
independent output dividers scale the frequency down to the
desired output frequencies. With a given input and VCXO
frequency, the output frequency is a function of the P, MV, MF
and NA, NB, NC dividers, and can be set by pulling configuration
pins high or low. See “ICS813076I Examples Frequency Con-
figuration (f
VCXO= 30.72MHz)” for typical device configurations.
Note that for correct operation, the input frequency times the
MV-divider must be 30.72MHz ± 50ppm. The ICS813076I
supports up to three output frequencies f
OUT independently.
30.72MH z
XTALIN
XTALOUT
30.72MHz
VCXO
MV = 1
P = 1
FemtoClock PLL
VCO = 614.4MHz
MF = 20
N = 4
153.6MHz
Qn
CLK
ICS813076I
FIGURE 1. APPLICATION EXAMPLE (153.6MHZ CLOCK GENERATION AND JITTER ATTENUATION)
TABLE 2. PIN CHARACTERISTICS
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Ω
相關(guān)PDF資料 |
PDF描述 |
|---|---|
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參數(shù)描述 |
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