參數(shù)資料
型號(hào): STP1100BGA-100
元件分類: 微控制器/微處理器
英文描述: 32-BIT, 100 MHz, RISC PROCESSOR, PBGA272
封裝: PLASTIC, BGA-272
文件頁數(shù): 32/32頁
文件大小: 168K
代理商: STP1100BGA-100
9
SPARC v8 32-Bit Microprocessor With PCI/DRAM Interfaces
microSPARC-IIep
STP1100BGA
Preliminary
December 1997
Sun Microsystems, Inc
Miscellaneous Signals
Signal
Type
Note
Description
INPUT_RESET_L
In
4.
Power-up reset input pin.
BM_SEL[1:0]
In
4.
Boot Mode Select.
00 = 32-bit ash memory on local memory bus (cacheable after boot).
01 = 8-bit ash memory on local memory bus (cacheable after boot).
10 = PCI memory fetch from addresses f000.0000 - f0ff.ffff (non-cacheable).
11 = PCI memory fetch from addresses fffe.0000 - ffff.ffff (non-cacheable).
After booting from PCI (BM_SEL[1:0] = 10 or 11) the Flash memory defaults to the 32-bit
ash memory interface.
EXT_EVENT_L
In
5.
Input pin that can be used to stop internal clocks based on an external trigger.
INT_EVENT_L
Out
3.
Output pin that can be used to trigger external events based on an internal trigger.
IIDDTN
In
7.
Reserved for test Tie to VSS1 for normal operation.
TN
In
7.
Reserved for test. Tie to VDD1 for normal operation.
THERM_D
In
7.
Reserved for test. Tie to VSS1 for normal operation
SCAN_MODE
In
7.
Reserved for test. Tie to VSS1 for normal operation.
PROCMON
Out
Reserved for test. Do Not Connect.
VDD4, VSS4
In
PLL power/ground.
VDD2,VDD3
In
Reference power.
VDD1, VSS1
In
Core power/ground.
相關(guān)PDF資料
PDF描述
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參數(shù)描述
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