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參數(shù)資料
| 型號： | STP1100BGA-100 |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 32-BIT, 100 MHz, RISC PROCESSOR, PBGA272 |
| 封裝： | PLASTIC, BGA-272 |
| 文件頁數(shù)： | 31/32頁 |
| 文件大?。?/td> | 168K |
| 代理商： | STP1100BGA-100 |
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8
STP1100BGA
Preliminary
SPARC v8 32-Bit Microprocessor With PCI/DRAM Interfaces
microSPARC-IIep
December 1997
Sun Microsystems, Inc
ROM_CS_L
Out
3.
Flash memory Chip Select.
ROM_OE_L
Out
3.
Flash memory Output Enable.
ROM_WE_L
Out
3.
Flash memory Write Enable.
Clock and Timing Signals
Signal
Type
Note
Description
DIV_CTL[1:0]
In
4.
These two input pins set the multiplication factor for the EXT_CLK1 clock input pin to the
internal processor clock and internal system clock as shown in
Table 2.
SP_SEL[2:0]
In
4.
Memory Speed Select. Selects memory interface timing. Refer to
Table 3 for settings.
REF_CLOCK
Out
3.
Clock output at frequency of processor core. Used for testing and monitoring.
EXT_CLK1
In
8.
External Input Clock 1. While under PLL-bypass mode, an EXclusiveOR is performed on
EXT_CLK1 and EXT_CLK2 to produce the processor clock. Otherwise, EXT_CLK1 is
used to produce the processor clock using the Phase-Locked Loop.
EXT_CLK2
(MODE select)
In
4.
External Input Clock 2. While under PLL-bypass mode, an EXclusiveOR is performed on
EXT_CLK1 and EXT_CLK2 to produce the processor clock. Otherwise, during power-up,
EXT_CLK2 is used to select PCI Host or Satellite mode. Therefore, while PLL is not
bypassed, if EXT_CLK2 is tied high, microSPARC-IIep functions in PCI Satellite mode.
microSPARC-IIep functions in PCI Host mode by default.
PLL_BYP_L
In
5.
PLL-bypass mode select.
When tied high during power-up, microSPARC-IIep output of Phase-Locked Loop is used
to generate processor clock.
When tied low during power-up, PLL-bypass mode is selected and the processor clock is
generated using EXclusiveOR of EXT_CLK1 and EXT_CLK2.
PLL_RST
In
5.
Low until VDD1 > 2.0V and for 2 us or more when power-up.
JTAG Signals
Signal
Type
Note
Description
JTAG_CK
In
5.
Clock for boundary scan registers.
JTAG_MS
In
5.
Mode Select.
JTAG_TDI
In
5.
Test Data Input.
JTAG_TRST_L
In
4.
Test Reset.
JTAG_TDO
Out
3.
Test Data Output.
DRAM and Flash Memory Signals (Continued)
Signal
Type
Note
Description
相關(guān)PDF資料 |
PDF描述 |
|---|---|
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
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| STP110N8F7 | 功能描述:MOSFET N-CH 80V 80A TO-220 制造商:stmicroelectronics 系列:STripFET?? 包裝:管件 零件狀態(tài):有效 FET 類型:MOSFET N 通道，金屬氧化物 FET 功能:標(biāo)準(zhǔn) 漏源極電壓（Vdss）:80V 電流 - 連續(xù)漏極（Id）（25°C 時）:80A（Tc） 不同?Id，Vgs 時的?Rds On（最大值）:7.5 毫歐 @ 40A，10V 不同 Id 時的 Vgs（th）（最大值）:4.5V @ 250μA 不同 Vgs 時的柵極電荷（Qg）:46.8nC @ 10V 不同 Vds 時的輸入電容（Ciss）:3435pF @ 40V 功率 - 最大值:170W 工作溫度:-55°C ~ 175°C（TJ） 安裝類型:通孔 封裝/外殼:TO-220-3 供應(yīng)商器件封裝:TO-220 標(biāo)準(zhǔn)包裝:50 |
| STP1141 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:STP1141/1151 系列超低壓差，帶開關(guān)端集成穩(wěn)壓器 |
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