參數(shù)資料
型號: DS2156
英文描述: T1/E1/J1 Single-Chip Transceiver TDM/UTOPIA II Interface
中文描述: T1/E1/J1單芯片收發(fā)器,TDM/UTOPIA II接口
文件頁數(shù): 230/262頁
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代理商: DS2156
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DS2156
230 of 262
Table 33-D. Boundary Scan Control Bits
( ) = Alternate function when in UTOPIA backplane mode.
BIT
PIN
NAME
TYPE
CONTROL BIT FUNCTION
3
1
2
RCHBLK (UR_SOC)
JTMS
O
I
0 = BPCLK is an input (UR_ENB)
1 = BPCLK is an output
0 = UOP0 is an input UT_SOC
1 = UOP0 is an output
0 = UOP1 is an input UT_ENB
1 = UOP1 is an output
0 = LIUC is an input
1 = LIUC is an output (UT_CLAV)
0 = UOP3 is an input (UT_ADDR0)
1 = UOP3 is an output
0 = TCHBLK is an input (UT_ADDR1)
1 = TCHBLK is an output
2
BPCLK.cntl
1
0
3
4
5
6
7
BPCLK (UR_ENB)
JTCLK
JTRST
RCL
JTDI
I/O
I
I
O
I
98
UOP0.cntl
97
8
UOP0 (UT_SOC)
I/O
96
UOP1.cntl
95
94
9
10
11
UOP1 (UT_ENB)
JTDO
BTS
I/O
O
I
93
LIUC.cntl
92
91
90
89
12
13
14
15
16
17
18
LIUC (UT_CLAV)
8XCLK
TSTRST
UOP2
RTIP
RRING
RVDD
RVSS
MCLK
XTALD
I/O
O
I
O
I
I
I
O
19, 20, 24
21
22
88
UOP3.cntl
87
86
85
23
25
26
UOP3 (UT_ADDR0)
INT
TUSEL
N.C.
TTIP
TVSS
TVDD
TRING
I/O
O
I
O
O
27, 28
29
30
31
32
84
TCHBLK.cntl
83
33
TCHBLK
(UT_ADDR1)
I/O
82
TLCLK.cntl
0 = TLCLK is an input (UT_ADDR2)
1 = TLCLK is an output
0 = ESIBS0 is an input
1 = ESIBS0 is an output
0 = TSYNC is an input
81
80
34
35
TLCLK (UT_ADDR2)
TLINK (UT_ADDR3)
I/O
I
79
ESIBS0.cntl
78
77
36
ESIBS0
TSYNC.cntl
I/O
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PDF描述
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DS2156LN T1/E1/J1 Single-Chip Transceiver TDM/UTOPIA II Interface
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DS2182A T1 Line Monitor
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DS2156G 制造商:Maxim Integrated Products 功能描述:DS2156 T1/E1/J1 SCT+UTOPIA 100BGA - Trays
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