參數(shù)資料
型號： DS2156
英文描述： T1/E1/J1 Single-Chip Transceiver TDM/UTOPIA II Interface
中文描述： T1/E1/J1單芯片收發(fā)器，TDM/UTOPIA II接口
文件頁數(shù)： 145/262頁
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代理商： DS2156
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DS2156
145 of 262
22.3.5
Register Name:
Register Description:
HDLC FIFOs
H1TF, H2TF
HDLC # 1 Transmit FIFO
HDLC # 2 Transmit FIFO
9Dh, ADh
Register Address:
Bit #
Name
Default
Bit 0/Transmit HDLC Data Bit 0 (THD0).
LSB of an HDLC packet data byte.
Bit 1/Transmit HDLC Data Bit 1 (THD1)
Bit 2/Transmit HDLC Data Bit 2 (THD2)
Bit 3/Transmit HDLC Data Bit 3 (THD3)
Bit 4/Transmit HDLC Data Bit 4 (THD4)
Bit 5/Transmit HDLC Data Bit 5 (THD5)
Bit 6/Transmit HDLC Data Bit 6 (THD6)
Bit 7/Transmit HDLC Data Bit 7 (THD7).
MSB of an HDLC packet data byte.
Register Name:
H1RF, H2RF
Register Description:
HDLC # 1 Receive FIFO
HDLC # 2 Receive FIFO
Register Address:
9Eh, AEh
Bit #
7
6
5
Name
RHD7
RHD6
RHD5
Default
0
0
0
Bit 0/Receive HDLC Data Bit 0 (RHD0).
LSB of an HDLC packet data byte.
Bit 1/Receive HDLC Data Bit 1 (RHD1)
Bit 2/Receive HDLC Data Bit 2 (RHD2)
Bit 3/Receive HDLC Data Bit 3 (RHD3)
Bit 4/Receive HDLC Data Bit 4 (RHD4)
Bit 5/Receive HDLC Data Bit 5 (RHD5)
Bit 6/Receive HDLC Data Bit 6 (RHD6)
Bit 7/Receive HDLC Data Bit 7 (RHD7).
MSB of an HDLC packet data byte.
7
6
5
4
3
2
1
0
THD7
0
THD6
0
THD5
0
THD4
0
THD3
0
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0
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0
THD0
0
4
3
2
1
0
RHD4
0
RHD3
0
RHD2
0
RHD1
0
RHD0
0
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PDF描述
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DS2156LN T1/E1/J1 Single-Chip Transceiver TDM/UTOPIA II Interface
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DS2182A T1 Line Monitor
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參數(shù)描述
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DS2156G 制造商:Maxim Integrated Products 功能描述:DS2156 T1/E1/J1 SCT+UTOPIA 100BGA - Trays
DS2156G+ 制造商:MAXIM 制造商全稱:Maxim Integrated Products 功能描述:T1/E1/J1 Single-Chip Transceiver TDM/UTOPIA II Interface
DS2156GN 制造商:MAXIM 制造商全稱:Maxim Integrated Products 功能描述:T1/E1/J1 Single-Chip Transceiver TDM/UTOPIA II Interface
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