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參數(shù)資料
| 型號(hào)： | DS21458N |
| 英文描述： | Quad T1/E1/J1 Transceivers |
| 中文描述： | 四T1/E1/J1收發(fā)器 |
| 文件頁數(shù)： | 164/270頁 |
| 文件大?。?/td> | 1652K |
| 代理商： | DS21458N |
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DS21455/DS21458 Quad T1/E1/J1 Transceivers
164 of 270
25.7 LIU Control Registers
Register Name:
Register Description:
Register Address:
Bit #
7
Name
L2
Default
0
Bit 0/Transmit Power-Down (TPD).
This bit along with the LIUC/TPD pin and the LTS (LBCR.7) bit controls the transmit
power-down function.
0 = powers down the transmitter and tri-states the TTIP and TRING pins
1 = normal transmitter operation
Table 25-1. TPD CONTROL
LIC1
Line Interface Control 1
78h
6
L1
0
5
L0
0
4
3
2
1
0
EGL
0
JAS
0
JABDS
0
DJA
0
TPD
0
LBCR.7
(LTS)
0
0
1
1
1
1
LIUC/TPD
PIN
X
X
0
0
1
1
LIC1.0
(TPD)
0
1
0
1
0
1
FUNCTION
Transmitter in power-down mode, TTIP and TRING tri-stated
Transmitter enabled
Transmitter in power-down mode, TTIP and TRING tri-stated
Transmitter enabled
Transmitter in power-down mode, TTIP and TRING tri-stated
Transmitter in power-down mode, TTIP and TRING tri-stated
Bit 1/Disable Jitter Attenuator (DJA).
0 = jitter attenuator enabled
1 = jitter attenuator disabled
Bit 2/Jitter Attenuator Buffer Depth Select (JABDS).
0 = 128 bits
1 = 32 bits (use for delay sensitive applications)
Bit 3/Jitter Attenuator Select (JAS).
0 = place the jitter attenuator on the receive side
1 = place the jitter attenuator on the transmit side
Bit 4/Receive Equalizer Gain Limit (EGL).
This bit controls the sensitivity of the receive equalizer.
T1 Mode:
0 = -36dB (long haul)
1 = -15dB (limited long haul)
E1 Mode:
0 = -12dB (short haul)
1 = -43dB (long haul)
Bits 5 to 7/Line Build-Out Select (L0 to L2).
These bits select the output waveshape. See
Table 25-2
,
Table 25-3
,
Table
25-4
, and
Table 25-5
for the correct register settings for specific applications. In E1 mode, when using the internal termination,
the user needs only to select 000 for 75
operation or 001 for 120
operation. Using TT0 and TT1 of the LICR4 register,
users can then select the proper internal source termination. Line build-outs 100 and 101 are provided for backward
compatibility with older products only.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
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| DS2148G | 5V E1/T1/J1 Line Interface |
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| DS2148T | 5V E1/T1/J1 Line Interface |
| DS2148TN | 5V E1/T1/J1 Line Interface |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| DS21458N+ | 功能描述:網(wǎng)絡(luò)控制器與處理器 IC Quad E1-T1-J1 Transceiver RoHS:否 制造商:Micrel 產(chǎn)品:Controller Area Network (CAN) 收發(fā)器數(shù)量: 數(shù)據(jù)速率: 電源電流（最大值）:595 mA 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:PBGA-400 封裝:Tray |
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| DS2145Q | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Telecommunication IC |
| DS2145QN | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Telecommunication IC |
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