參數(shù)資料
型號(hào)： CY7C09579V
廠商： Cypress Semiconductor Corp.
英文描述： 3.3V 32K x 36 FLEx36 Synchronous Dual-Port Static RAM(3.3V 32K x 36 同步雙端口靜態(tài) RAM)
中文描述： 3.3 32K的× 36 FLEx36同步雙端口靜態(tài)RAM（3.3 32K的× 36同步雙端口靜態(tài)RAM）的
文件頁(yè)數(shù)： 23/30頁(yè)
文件大小： 1059K
代理商： CY7C09579V
CY7C09569V
CY7C09579V
Document #: 38-06054 Rev. *B
Page 23 of 30
Read/Write and Enable Operation
[37, 38, 39]
Inputs
Outputs
I/O
0
–
I/O
35
High-Z
OE
X
CLK
CE
H
R/W
X
Operation
Deselected
[40]
X
L
L
D
IN
Write
L
L
H
D
OUT
Read
[40]
H
X
L
X
High-Z
Outputs Disabled
Address Counter Control Operation
[37, 41]
Address
X
Previous
Address
X
CLK
OE
X
R/W
X
ADS
X
CNTEN
X
CNTRST
L
Mode
Reset
Operation
Counter Reset
A
n
X
X
X
L
L
H
Load
Address Load into Counter
A
n
A
n
L
H
L
H
H
Hold +
Read
Hold
External Address Blocked -
Counter Address Readout
External Address Blocked -
Counter Disabled
Increment Counter Increment
X
A
n
X
X
H
H
H
X
A
n
X
X
H
L
H
Notes:
37.“X” = “Don’t Care,” “H” = V
, “L” = V
.
38.ADS, CNTEN, CNTRST = “Don’t Care.”
39.OE is an asynchronous input signal.
40.When CE changes state In the pipelined mode, deselection and read happen in the following clock cycle.
41.Counter operation is independent of CE.
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PDF描述
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