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參數(shù)資料
| 型號(hào)： | CY2DP3120 |
| 英文描述： | Clocks and Buffers |
| 中文描述： | 時(shí)鐘和緩沖器 |
| 文件頁(yè)數(shù)： | 7/11頁(yè) |
| 文件大?。?/td> | 92K |
| 代理商： | CY2DP3120 |
PRELIMINARY
FastEdge Series
CY2DP3120
Document #: 38-07514 Rev. *A
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tr, tf,
20-80%
VO(p-p)
Figure 4. ECL/LVPECL Output
VOD
VPP /
VDIF
TPD
Figure 5. TPD Propagation Delay of Both CLKA or CLKB to (Q0–Q19),Q0#–Q0#19 Pair
PECL/ECL/HSTL to PECL/ECL
ts k (P ) O u tp u t p u ls e s k ew
= | tP L H - tP H L |
V P P /
V D IF
V O (P -P )
tP L H
tP H L
Figure 6. Output Pulse Skew
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| CY2LL8422 | Clocks and Buffers |
| CY2LL843 | Clocks and Buffers |
| CY2LL842 | Clocks and Buffers |
| CY2PD817 | Clocks and Buffers |
| CY2PP3115 | Clocks and Buffers |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| CY2DP3120AI | 制造商:CYPRESS 制造商全稱:Cypress Semiconductor 功能描述:1:20 Differential Clock/Data Fanout Buffer |
| CY2DP3120AIT | 制造商:CYPRESS 制造商全稱:Cypress Semiconductor 功能描述:1:20 Differential Clock/Data Fanout Buffer |
| CY2DP3120AXI | 制造商:CYPRESS 制造商全稱:Cypress Semiconductor 功能描述:1:20 Differential Clock/Data Fanout Buffer |
| CY2DP3120AXIT | 制造商:CYPRESS 制造商全稱:Cypress Semiconductor 功能描述:1:20 Differential Clock/Data Fanout Buffer |
| CY2DP314 | 制造商:CYPRESS 制造商全稱:Cypress Semiconductor 功能描述:1:4 Differential Clock/Data Fanout Buffer |
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