參數(shù)資料
型號(hào)： CXD3068Q
廠商： Sony Corporation
元件分類： 數(shù)字信號(hào)處理
英文描述： CD Digital Signal Processor with Built-in Digital Servo(CD數(shù)字信號(hào)處理器（內(nèi)置數(shù)字伺服系統(tǒng)）)
中文描述： CD數(shù)字信號(hào)處理器具有內(nèi)置的數(shù)字式伺服（光盤數(shù)字信號(hào)處理器（內(nèi)置數(shù)字伺服系統(tǒng)））
文件頁(yè)數(shù)： 5/135頁(yè)
文件大?。?/td> 1259K
代理商： CXD3068Q
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O
—
I
I
I
I
I
I
I
I
O
—
I
—
O
I
I
—
I
O
I
O
—
I
I
I/O
O
—
I
I
O
O
O
O
1, 0
—
Analog
—
—
1, 0
—
Analog
1, Z, 0
—
1, 0
1, Z, 0
—
1, 0
1, 0
1, 0
1, 0
Focus drive output.
Digital GND.
Test. Normally, GND.
Test. Normally, GND.
Center voltage input.
Focus error signal input.
Sled error signal input.
Tracking error signal input.
Center servo analog input.
RF signal input.
Test. No connected.
Analog GND.
Constant current input for operational amplifier.
Analog power supply.
EFM full-swing output. (low = Vss, high = V
DD
)
Asymmetry comparator voltage input.
EFM signal input.
Analog GND.
Multiplier VCO1 control voltage input.
Master PLL filter output (slave = digital PLL).
Master PLL filter input.
Master PLL charge pump output.
Analog power supply.
Asymmetry circuit constant current input.
Wide-band EFM PLL VCO2 control voltage input.
Wide-band EFM PLL VCO2 oscillation output. Serves as wide-band EFM
PLL clock input by switching with the command.
Wide-band EFM PLL charge pump output.
Digital power supply.
Asymmetry circuit on/off (low = off, high = on).
Digital Out on/off control (low = off, high = on).
Digital Out output.
D/A interface. LR clock output. f = Fs
D/A interface. Serial data output (two's complement, MSB first).
D/A interface. Bit clock output.
FRDR
DV
SS
1
TEST
TES1
VC
FE
SE
TE
CE
RFDC
ADIO
AV
SS
0
IGEN
AV
DD
0
ASYO
ASYI
RFAC
AV
SS
1
CLTV
FILO
FILI
PCO
AV
DD
1
BIAS
VCTL
V16M
VPCO
DV
DD
2
ASYE
MD2
DOUT
LRCK
PCMD
BCK
Pin
No.
Symbol
I/O
Description
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PDF描述
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