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參數(shù)資料
| 型號(hào)： | CS8420-DSZ |
| 廠商： | Cirrus Logic Inc |
| 文件頁(yè)數(shù)： | 4/94頁(yè) |
| 文件大?。?/td> | 0K |
| 描述： | IC CONV S/R DGTL AUDIO 28-SOIC |
| 標(biāo)準(zhǔn)包裝： | 27 |
| 類型： | 采樣率轉(zhuǎn)換器 |
| 應(yīng)用： | 數(shù)字音頻 |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 28-SOIC（0.295"，7.50mm 寬） |
| 供應(yīng)商設(shè)備封裝： | 28-SOIC |
| 包裝： | 管件 |
| 產(chǎn)品目錄頁(yè)面： | 759 (CN2011-ZH PDF) |
| 其它名稱： | 598-1729 |
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12
DS245F4
CS8420
2.
TYPICAL CONNECTION DIAGRAM
CS8420
Cable
Termination
RXP
RXN
AES3/
SPDIF
Source
3-wire Serial
Audio Source
ILRCK
ISCLK
SDIN
Clock Source
and Control
RMCK
OMCK
Hardware
Control
RST
RERR
EMPH
TCBL
To other
CS8420's
Cable
Interface
AES3/
SPDIF
Equipment
TXP
TXN
3-wire Serial
Audio Input
Device
OLRCK
OSCLK
SDOUT
Microcontroller
SDA/CDOUT
AD0 / CS
SCL/CCLK
AD1/CDIN
U
INT
VA+
VD+
Ferrite *
Bead
+5V
Analog
Supply *
+5V
Digital
Supply
0.1 F
μ
0.1 F
μ
* A separate analog supply is only necessary in applications where
RMCK is used for a jitter sensitive task. For applications where
RMCK is not used for a jitter sensitive task, connect VA+ to VD+
via a ferrite bead. Keep the decoupling capacitor between VA+
and AGND.
DGND
FILT
AGND
RFILT
CFILT
CRIP
H/S
47k
Ω
/AD2
Figure 5. Recommended Connection Diagram for Software Mode
相關(guān)PDF資料 |
PDF描述 |
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| CY28346ZI-2 | IC CLOCK DIFF OUT CK408 56TSSOP |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
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| CS8421_09 | 制造商:CIRRUS 制造商全稱:Cirrus Logic 功能描述:32-bit, 192 kHz Asynchronous Sample Rate Converter |
| CS8421_10 | 制造商:CIRRUS 制造商全稱:Cirrus Logic 功能描述:32-bit, 192-kHz Asynchronous Sample Rate Converter |
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