參數(shù)資料
型號(hào)： AMD-K6-2
廠商： Advanced Micro Devices, Inc.
英文描述： 32 Bit Microprocessor With 64-Kbyte Level-one Cache High-Performance and Multimedia Execution Unit(帶64K字節(jié)緩存和高性能多媒體執(zhí)行單元的32位微處理器)
中文描述： 32位微處理器的64 -字節(jié)的一級(jí)緩存高性能和多媒體執(zhí)行單元（帶64K的字節(jié)緩存和高性能多媒體執(zhí)行單元的32位微處理器）
文件頁(yè)數(shù)： 243/328頁(yè)
文件大小： 4802K
代理商： AMD-K6-2
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Chapter 11
Test and Debug
225
21850I/0—December 1999
AMD-K6
-2 Processor Data Sheet
Preliminary Information
Loading 00001b into the IR shift register during the Capture-IR
state results in loading the SAMPLE/PRELOAD instruction.
For each entry into the Shift-IR state, the IR shift register is
serially shifted by one bit toward the TDO pin. During the shift,
the most significant bit of the IR shift register is loaded from
the TDI pin.
The IR output register is loaded from the IR shift register in the
Update-IR state, and the current instruction is defined by the IR
output register. See “TAP Instructions” on page 231 for a list and
definition of the instructions supported by the AMD-K6-2
processor.
Boundary Scan Register (BSR).
The BSR is a Test Data Register
consisting of the interconnection of 152 boundary-scan cells.
Each output and bidirectional pin of the processor requires a
two-bit cell, where one bit corresponds to the pin and the other
bit is the output enable for the pin. When a 0 is shifted into the
enable bit of a cell, the corresponding pin is floated, and when a
1 is shifted into the enable bit, the pin is driven valid. Each
input pin requires a one-bit cell that corresponds to the pin. The
last cell of the BSR is reserved and does not correspond to any
processor pin.
The total number of bits that comprise the BSR is 281. The
order of the bits in the BSR differs between the Model 8/[7:0]
and the Model 8/[F:8] processors. Table 47 on page 227 and
Table 48 on page 229 list the order of these bits, respectively,
where TDI is the input to bit 280, and TDO is driven from the
output of bit 0. The entries listed as
pin
_E (where
pin
is an
output or bidirectional signal) are the enable bits.
If the BSR is the register selected by the current instruction
and the TAP controller is in the Capture-DR state, the processor
loads the BSR shift register as follows:
I
If the current instruction is SAMPLE/PRELOAD, then the
current state of each input, output, and bidirectional pin is
loaded. A bidirectional pin is treated as an output if its
enable bit equals 1, and it is treated as an input if its enable
bit equals 0.
If the current instruction is EXTEST, then the current state
of each input pin is loaded. A bidirectional pin is treated as
an input, regardless of the state of its enable.
I
相關(guān)PDF資料
PDF描述
AMD-K6-III 32-Bit Microprocessor Advanced RISC86 Superscalar Microarchitecture and 3D Technology(32位微處理器帶3D技術(shù)和高級(jí)的RISC86超標(biāo)量微體系結(jié)構(gòu))
AMD-K6 Circular Connector; No. of Contacts:5; Series:MS27497; Body Material:Aluminum; Connecting Termination:Crimp; Connector Shell Size:14; Circular Contact Gender:Pin; Circular Shell Style:Wall Mount Receptacle; Insert Arrangement:14-5 RoHS Compliant: No
AMD27C64-150PI 64 Kilobit (8,192 x 8-Bit) CMOS EPROM
AMD27C64 64 Kilobit (8,192 x 8-Bit) CMOS EPROM
AMD27C64-120DC 64 Kilobit (8,192 x 8-Bit) CMOS EPROM
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
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AMDK62/350AFK 制造商:Advanced Micro Devices 功能描述:
AMD-K6-2/400ACR 制造商:Advanced Micro Devices 功能描述:32-BIT, 400 MHZ, RISC PROCESSOR, CPGA321
AMD-K6-2/500AFX 制造商:Advanced Micro Devices 功能描述:32-BIT, 500 MHz, RISC PROCESSOR, CPGA321
AMD-K6-2+/450ACR 制造商:Advanced Micro Devices 功能描述:32-BIT, 450 MHZ, RISC PROCESSOR, CPGA321
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