- 您現(xiàn)在的位置：買賣IC網(wǎng) > PDF目錄366557 > AMD-K6-2 (Advanced Micro Devices, Inc.) 32 Bit Microprocessor With 64-Kbyte Level-one Cache High-Performance and Multimedia Execution Unit(帶64K字節(jié)緩存和高性能多媒體執(zhí)行單元的32位微處理器) PDF資料下載
參數(shù)資料
| 型號： | AMD-K6-2 |
| 廠商： | Advanced Micro Devices, Inc. |
| 英文描述： | 32 Bit Microprocessor With 64-Kbyte Level-one Cache High-Performance and Multimedia Execution Unit(帶64K字節(jié)緩存和高性能多媒體執(zhí)行單元的32位微處理器) |
| 中文描述： | 32位微處理器的64 -字節(jié)的一級緩存高性能和多媒體執(zhí)行單元（帶64K的字節(jié)緩存和高性能多媒體執(zhí)行單元的32位微處理器） |
| 文件頁數(shù)： | 12/328頁 |
| 文件大小： | 4802K |
| 代理商： | AMD-K6-2 |
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xii
List of Figures
AMD-K6
-2 Processor Data Sheet
21850I/0—December 1999
Preliminary Information
Figure 37.
Figure 38.
Figure 39.
Figure 40.
Figure 41.
Figure 42.
Figure 43.
Figure 44.
Figure 45.
Figure 46.
Figure 47.
Figure 48.
Figure 49.
Figure 50.
Figure 51.
Figure 52.
Figure 53.
Figure 54.
Figure 55.
Memory Management Registers. . . . . . . . . . . . . . . . . . . . . . . . . 41
Task State Segment (TSS). . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 42
4-Kbyte Paging Mechanism. . . . . . . . . . . . . . . . . . . . . . . . . . . . . 43
4-Mbyte Paging Mechanism . . . . . . . . . . . . . . . . . . . . . . . . . . . . 44
Page Directory Entry 4-Kbyte Page Table (PDE). . . . . . . . . . .45
Page Directory Entry 4-Mbyte Page Table (PDE) . . . . . . . . . . 45
Page Table Entry (PTE). . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .46
Application Segment Descriptor . . . . . . . . . . . . . . . . . . . . . . . . 47
System Segment Descriptor . . . . . . . . . . . . . . . . . . . . . . . . . . . . 48
Gate Descriptor . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 49
Extended Feature Enable Register (EFER)—Model 8/[F:8]. . 51
Write Handling Control Register (WHCR)—Model 8/[F:8] . . 52
UC/WC Cacheability Control Register (UWCCR) . . . . . . . . . . 52
Processor State Observability Register (PSOR) . . . . . . . . . . . . 53
Page Flush/Invalidate Register (PFIR) . . . . . . . . . . . . . . . . . . . 53
Logic Symbol Diagram. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 84
Waveform Definitions . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 128
Bus State Machine Diagram . . . . . . . . . . . . . . . . . . . . . . . . . . . 129
Non-Pipelined Single-Transfer Memory Read/Write
and Write Delayed by EWBE# . . . . . . . . . . . . . . . . . . . . . . . . .133
Misaligned Single-Transfer Memory Read and Write . . . . . . 135
Burst Reads and Pipelined Burst Reads . . . . . . . . . . . . . . . . . 137
Burst Writeback due to Cache-Line Replacement . . . . . . . . . 139
Basic I/O Read and Write . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 140
Misaligned I/O Transfer. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .141
Basic HOLD/HLDA Operation . . . . . . . . . . . . . . . . . . . . . . . . .143
HOLD-Initiated Inquire Hit to Shared or Exclusive Line . . . 145
HOLD-Initiated Inquire Hit to Modified Line. . . . . . . . . . . . . 147
AHOLD-Initiated Inquire Miss . . . . . . . . . . . . . . . . . . . . . . . . . 149
AHOLD-Initiated Inquire Hit to Shared or Exclusive Line. . 151
AHOLD-Initiated Inquire Hit to Modified Line . . . . . . . . . . . 153
AHOLD Restriction . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 155
BOFF# Timing. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 157
Basic Locked Operation. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .159
Locked Operation with BOFF# Intervention. . . . . . . . . . . . . . 161
Interrupt Acknowledge Operation . . . . . . . . . . . . . . . . . . . . . . 163
Basic Special Bus Cycle (Halt Cycle) . . . . . . . . . . . . . . . . . . . .165
Shutdown Cycle . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 166
Stop Grant and Stop Clock Modes, Part 1 . . . . . . . . . . . . . . . . 168
Figure 56.
Figure 57.
Figure 58.
Figure 59.
Figure 60.
Figure 61.
Figure 62.
Figure 63.
Figure 64.
Figure 65.
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Figure 69.
Figure 70.
Figure 71.
Figure 72.
Figure 73.
Figure 74.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| AMD-K6-III | 32-Bit Microprocessor Advanced RISC86 Superscalar Microarchitecture and 3D Technology(32位微處理器帶3D技術(shù)和高級的RISC86超標(biāo)量微體系結(jié)構(gòu)) |
| AMD-K6 | Circular Connector; No. of Contacts:5; Series:MS27497; Body Material:Aluminum; Connecting Termination:Crimp; Connector Shell Size:14; Circular Contact Gender:Pin; Circular Shell Style:Wall Mount Receptacle; Insert Arrangement:14-5 RoHS Compliant: No |
| AMD27C64-150PI | 64 Kilobit (8,192 x 8-Bit) CMOS EPROM |
| AMD27C64 | 64 Kilobit (8,192 x 8-Bit) CMOS EPROM |
| AMD27C64-120DC | 64 Kilobit (8,192 x 8-Bit) CMOS EPROM |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| AMD-K6-2/300AFR | 制造商:Advanced Micro Devices 功能描述:Microprocessor, 32 Bit, 321 Pin, Ceramic, PGA |
| AMDK62/350AFK | 制造商:Advanced Micro Devices 功能描述: |
| AMD-K6-2/400ACR | 制造商:Advanced Micro Devices 功能描述:32-BIT, 400 MHZ, RISC PROCESSOR, CPGA321 |
| AMD-K6-2/500AFX | 制造商:Advanced Micro Devices 功能描述:32-BIT, 500 MHz, RISC PROCESSOR, CPGA321 |
| AMD-K6-2+/450ACR | 制造商:Advanced Micro Devices 功能描述:32-BIT, 450 MHZ, RISC PROCESSOR, CPGA321 |
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