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參數(shù)資料
| 型號： | AM79C971VCW |
| 廠商： | ADVANCED MICRO DEVICES INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | PCnet⑩-FAST Single-Chip Full-Duplex 10/100 Mbps Ethernet Controller for PCI Local Bus |
| 中文描述： | 4 CHANNEL(S), 100M bps, LOCAL AREA NETWORK CONTROLLER, PQFP176 |
| 封裝： | TQFP-176 |
| 文件頁數(shù)： | 144/265頁 |
| 文件大?。?/td> | 3190K |
| 代理商： | AM79C971VCW |
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144
Am79C971
P R E L I M I N A R Y
When an external SRAM is used,
SRAM_SIZE > 0, there is a re-
striction that the number of bytes
written is a combination of bytes
written into the Bus Transmit
FIFO and the MAC Transmit
FIFO. The Am79C971 controller
supports a mode that will wait un-
til a full packet is available before
commencing with the transmis-
sion of preamble. This mode is
useful in a system where high la-
tencies cannot be avoided. See
Table 28.
Table 28.
Transmit Start Point Programming
NOTE: A
“
No SRAM configuration
”
is
only valid for 10Mb mode. In 100Mb
mode, SRAM is mandatory and must
always be used.
Read/Write accessible only when
either the STOP or the SPND bit
is set. XMTSP is set to a value of
01b (64 bytes) after H_RESET or
S_RESET and is unaffected by
STOP.
9-8
XMTFW[1:0] Transmit FIFO Watermark. XMT-
FW specifies the point at which
transmit DMA is requested,
based upon the number of bytes
that could be written to the Trans-
mit FIFO without FIFO overflow.
Transmit DMA is requested at
any time when the number of
bytes specified by XMTFW could
be written to the FIFO without
causing Transmit FIFO overflow,
and the internal microcode en-
gine has reached a point where
the Transmit FIFO is checked to
determine if DMA servicing is re-
quired.
When operating in the NO-SRAM
mode
(no
SRAM
SRAM_SIZE set to 0, the Bus
Transmit FIFO and the MAC
Transmit FIFO operate like a sin-
gle FIFO and the watermark val-
ue selected by XMTFW[1:0] sets
the number of FIFO byte loca-
tions that must be available in the
FIFO before receive DMA is re-
quested.
present),
NOTE: A
“
No SRAM configura-
tion
”
is only valid for 10Mb mode.
In 100Mb mode, SRAM is man-
datory and must always be used.
When operating with an external
SRAM, the Bus Transmit FIFO
and the MAC Transmit FIFO op-
erate independently on the bus
side and MAC side of the external
SRAM, respectively. In this case,
the watermark value set by XMT-
FW[1:0] sets the number of FIFO
byte locations that must be avail-
able in the Bus Transmit FIFO.
See Table 29.
Read/Write accessible only when
either the STOP or the SPND bit
is set. XMTFW is set to a value of
00b (16 bytes) after H_RESET or
S_RESET and is unaffected by
STOP.
7-0
DMATC[7:0] DMA Transfer Counter. Writing
and reading to this field has no ef-
fect.
Use
MIN_GNT in the PCI configura-
tion space.
MAX_LAT
and
CSR82: Transmit Descriptor Address Pointer Lower
Bit
Name
Description
31-16 RES
Reserved locations. Written as
zeros and read as undefined.
XMTSP[1:0]
00
01
10
11
00
01
10
11
SRAM_SIZE
0
0
0
0
>0
>0
>0
>0
Bytes Written
20
64
128
248
44
64
128
Full Packet
Table 29.
Transmit Watermark Programming
XMTFW[1:0]
00
01
10
11
Bytes Available
16
64
108
Reserved
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| AM79C971 | PCnet⑩-FAST Single-Chip Full-Duplex 10/100 Mbps Ethernet Controller for PCI Local Bus |
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參數(shù)描述 |
|---|---|
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| AM79C972BKC\\W | 制造商:Advanced Micro Devices 功能描述: |
| AM79C972BKC\W | 制造商:Advanced Micro Devices 功能描述: |
| AM79C972BKCW | 制造商:AMD 制造商全稱:Advanced Micro Devices 功能描述:PCnet⑩-FAST+ Enhanced 10/100 Mbps PCI Ethernet Controller with OnNow Support |
| AM79C972BKD/W | 制造商:Advanced Micro Devices 功能描述: |
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