參數(shù)資料
型號(hào)： ADSP-BF535
廠商： Analog Devices, Inc.
英文描述： Blackfin Embedded Processor
中文描述： Blackfin嵌入式處理器
文件頁(yè)數(shù)： 33/44頁(yè)
文件大?。?/td> 1388K
代理商： ADSP-BF535
–33–
REV. A
ADSP-BF535
Serial Peripheral Interface (SPI) Port
—Slave Timing
Table 24
and
Figure 16
describe SPI port slave operations.
Table 24. Serial Peripheral Interface (SPI) Port—Slave Timing
Parameter
Timing Requirements
t
SPICHS
t
SPICLS
t
SPICLK
t
HDS
t
SPITDS
t
SDSCI
t
SSPID
t
HSPID
Min
Max
Unit
Serial Clock High Period
Serial Clock Low Period
Serial Clock Period
Last SPICLK Edge to
SPISS
Not Asserted
Sequential Transfer Delay
SPISS
Assertion to First SCK Edge
Data Input Valid to SCK Edge (Data Input Setup)
SCK Sampling Edge to Data Input Invalid
2t
SCLK
2t
SCLK
4t
SCLK
2t
SCLK
2t
SCLK
2t
SCLK
1.6
1.6
ns
ns
ns
ns
ns
ns
ns
ns
Switching Characteristics
t
DSOE
t
DSDHI
t
DDSPID
t
HDSPID
SPISS
Assertion to Data Out Active
SPISS
Deassertion to Data High Impedance
SCK Edge to Data Out Valid (Data Out Delay)
SCK Edge to Data Out Invalid (Data Out Hold)
0.0
0.0
0.0
0.0
6.0
6.5
7.0
6.5
ns
ns
ns
ns
Figure 16. Serial Peripheral Interface (SPI) Port—Slave Timing
t
HSPID
t
DDSPID
t
DSDHI
LSB
MSB
MSB
VALID
t
HSPID
t
DSOE
t
DDSPID
t
HDSPID
MISO
(OUTPUT)
MOSI
(INPUT)
t
SSPID
SPISSx
(INPUT)
SCK
(CPOL = 0)
(INPUT)
SCK
(CPOL = 1)
(INPUT)
t
SDSCI
t
SPICHS
t
SPICLS
t
SPICLS
t
SPICLK
t
HDS
t
SPICHS
t
SSPID
t
HSPID
t
DSDHI
LSB
VALID
MSB
MSB
VALID
t
DSOE
t
DDSPID
MISO
(OUTPUT)
MOSI
(INPUT)
t
SSPID
LSB
VALID
LSB
CPHA = 1
CPHA = 0
t
SPITDS
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