參數(shù)資料
型號(hào): ADSP-BF535
廠商: Analog Devices, Inc.
英文描述: Blackfin Embedded Processor
中文描述: Blackfin嵌入式處理器
文件頁(yè)數(shù): 29/44頁(yè)
文件大?。?/td> 1388K
代理商: ADSP-BF535
–29–
REV. A
ADSP-BF535
SDRAM Interface Timing
For proper SDRAM controller operation, the maximum load
capacitance is 50 pF for ADDR, DATA,
ABE3–0
/SDQM3–0
,
CLKOUT/SCLK1, SCLK0, SCKE, SA10,
SRAS
,
SCAS
,
SWE
,
and
SMS3-0
.
Table 16. SDRAM Interface Timing
Parameter
Timing Requirements
t
SSDAT
t
HSDAT
Min
Max
Unit
DATA Setup Before SCLK0/SCLK1
DATA Hold After SCLK0/SCLK1
2.1
2.8
ns
ns
Switching Characteristics
t
SCLK
t
SCLKH
t
SCLKL
t
DCAD
t
HCAD
t
DSDAT
t
ENSDAT
SCLK0/SCLK1 Period
SCLK0/SCLK1 Width High
SCLK0/SCLK1 Width Low
Command, ADDR, Data Delay After SCLK0/SCLK1
1
Command, ADDR, Data Hold After SCLK0/SCLK1
1
Data Disable After SCLK0/SCLK1
Data Enable After SCLK0/SCLK1
7.5
2.5
2.5
ns
ns
ns
ns
ns
ns
ns
6.0
0.8
6.0
1.0
1
Command pins include:
SRAS
,
SCAS
,
SWE
, SDQM3–0,
SMS
, SA10, and SCKE.
Figure 13. SDRAM Interface Timing
t
HCAD
t
HCAD
t
DSDAT
t
DCAD
t
SSDAT
t
DCAD
t
ENSDAT
t
HSDAT
t
SCLKL
t
SCLKH
t
SCLK
SCLK0/
SCLK1
DATA
(IN)
DATA
(OUT)
CMND1
ADDR
(OUT)
NOTE 1: COMMAND = SRAS, SCAS, SWE, SDQM3–0, SMS, SA10, AND SCKE.
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PDF描述
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