參數(shù)資料
型號： AD9557BCPZ-REEL7
廠商： Analog Devices Inc
文件頁數(shù)： 53/92頁
文件大?。?/td> 0K
描述： IC CLK XLATR PLL 1250MHZ 40LFCSP
產(chǎn)品變化通告： Minor Mask Change 11/Apr/2012
標準包裝： 750
類型： 時鐘/頻率轉(zhuǎn)換器
PLL： 是
主要目的： 以太網(wǎng)，SONET/SDH
輸入： CMOS，LVDS，LVPECL
輸出： CMOS，HSTL，LVDS
電路數(shù)： 1
比率 - 輸入:輸出： 2:2
差分 - 輸入:輸出： 是/是
頻率 - 最大： 1.25GHz
電源電壓： 1.71 V ~ 3.465 V
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 40-VFQFN 裸露焊盤，CSP
供應(yīng)商設(shè)備封裝： 40-LFCSP-VQ（6x6）
包裝： 帶卷 (TR)
Data Sheet
AD9557
Rev. B | Page 57 of 92
Reg
Addr
(Hex)
Opt
Name
D7
D6
D5
D4
D3
D2
D1
D0
Def
0x0209
IRQ pin
output
mode
Reserved
Status signal
at IRQ pin[1:0]
Use IRQ pin
for status
signal
IRQ pin driver type[1:0]
1F
0x020A
IRQ mask
Reserved
SYSCLK
unlocked
SYSCLK
locked
APLL
unlocked
APLL locked
APLL cal
complete
APLL cal
started
00
0x020B
Reserved
Pin
program
end
Sync
distribution
Watchdog
timer
EEPROM
fault
EEPROM
complete
00
0x020C
Switching
Closed
Freerun
Holdover
Frequency
unlocked
Frequency
locked
Phase
unlocked
Phase
locked
00
0x020D
Reserved
History
updated
Frequency
unclamped
Frequency
clamped
Phase slew
unlimited
Phase slew
limited
00
0x020E
Reserved
REFB
validated
REFB fault
cleared
REFB fault
Reserved
REFA
validated
REFA fault
cleared
REFA fault
00
0x020F
Reserved
00
0x0210
Watchdog
Timer 1
Watchdog timer (ms)[7:0]
00
0x0211
Watchdog timer (ms)[15:8]
00
0x0300
Free run
frequency
TW
30-bit free run frequency tuning word[7:0]
11
0x0301
30-bit free run frequency tuning word[15:8]
15
0x0302
30-bit free run frequency tuning word[23:16]
64
0x0303
Reserved
30-bit free run frequency tuning word[29:24]
1B
0x0304
Digital
oscillator
control
Reserved
DCO
4-level
output
Reserved
(must be 1b)
Reserved
10
0x0305
Reserved
00
0x0306
DPLL
frequency
clamp
Lower limit of pull-in range[7:0]
51
0x0307
Lower limit of pull-in range[15:8]
B8
0x0308
Reserved
Lower limit of pull-in range[19:16]
02
0x0309
Upper limit of pull-in range[7:0]
3E
0x030A
Upper limit of pull-in range[15:8]
0A
0x030B
Reserved
Upper limit of pull-in range[19:16]
0B
0x030C
Closed-loop
phase lock
offset
(±0.5 ms)
Fixed phase lock offset (signed; ps)[7:0]
00
0x030D
Fixed phase lock offset (signed; ps)[15:8]
00
0x030E
Fixed phase lock offset (signed; ps)[23:16]
00
0x030F
Reserved
Fixed phase lock offset (signed; ps)[29:24]
00
0x0310
Incremental phase lock offset step size (ps/step)[7:0] (up to 65.5 ns/step)
00
0x0311
Incremental phase lock offset step size (ps/step)[15:8] (up to 65.5 ns/step)
00
0x0312
Phase slew
rate limit
Phase slew rate limit (s/sec)[7:0] (315 s/sec up to 65.536 ms/sec)
00
0x0313
Phase slew rate limit (s/sec)[15:8] (315 s/sec up to 65.536 ms/sec)
00
0x0314
Holdover
history
History accumulation timer (ms)[7:0] (up to 65 seconds)
0A
0x0315
History accumulation timer (ms)[15:8] (up to 65 seconds)
00
0x0316
History
mode
Reserved
Single
sample
fallback
Persistent
history
Incremental average
00
0x0317
L
Base Loop
Filter A
coefficient
set (high
phase
margin)
HPM Alpha-0[7:0]
8C
0x0318
L
HPM Alpha-0[15:8]
AD
0x0319
L
Reserved
HPM Alpha-1[6:0]
4C
0x031A
L
HPM Beta-0[7:0]
F5
0x031B
L
HPM Beta-0[15:8]
CB
0x031C
L
Reserved
HPM Beta-1[6:0]
73
0x031D
L
HPM Gamma-0[7:0]
24
0x031E
L
HPM Gamma-0[15:8]
D8
0x031F
L
Reserved
HPM Gamma-1[6:0]
59
0x0320
L
HPM Delta-0[7:0]
D2
0x0321
L
HPM Delta-0[15:8]
8D
0x0322
L
Reserved
HPM Delta-1[6:0]
5A
相關(guān)PDF資料
PDF描述
AD9558BCPZ-REEL7 IC CLK XLATR PLL 1250MHZ 64LFCSP
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AD9559 制造商:AD 制造商全稱:Analog Devices 功能描述:Dual PLL, Quad Input, Multiservice Line Card Adaptive Clock Translator
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