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參數(shù)資料
| 型號： | AD9549ABCPZ-REEL7 |
| 廠商： | Analog Devices Inc |
| 文件頁數(shù)： | 70/76頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC CLOCK GEN/SYNCHRONIZR 64LFCSP |
| 產(chǎn)品變化通告： | AD9549A Mask Change 22/Oct/2010 |
| 標準包裝： | 750 |
| 類型： | 時鐘/頻率發(fā)生器，同步器 |
| PLL： | 是 |
| 主要目的： | 以太網(wǎng)，SONET/SDH，Stratum |
| 輸入： | CMOS，LVDS，LVPECL |
| 輸出： | CMOS，HSTL |
| 電路數(shù)： | 1 |
| 比率 - 輸入:輸出： | 2:2 |
| 差分 - 輸入:輸出： | 是/是 |
| 頻率 - 最大： | 750MHz |
| 電源電壓： | 1.71 V ~ 3.465 V |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 64-VFQFN 裸露焊盤，CSP |
| 供應(yīng)商設(shè)備封裝： | 64-LFCSP-VQ（9x9） |
| 包裝： | 帶卷 (TR) |
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AD9549
Rev. D | Page 72 of 76
Register 0x0500—Spur A
Table 133.
Bits
Bit Name
Description
7
HSR-A enable
Harmonic Spur Reduction A enable.
6
Amplitude gain × 2
[5:4]
Reserved
Reserved.
[3:0]
Spur A harmonic
Spur A Harmonic 1 to Spur A Harmonic 15.
Register 0x0501—Spur A (Continued)
Table 134.
Bits
Bit Name
Description
[7:0]
Spur A magnitude
Linear multiplier for Spur A magnitude.
Register 0x0503—Spur A (Continued)
Table 135.
Bits
Bit Name
Description
[7:0]
Spur A phase
Linear offset for Spur A phase.
Register 0x0504—Spur A (Continued)
Table 136.
Bits
Bit Name
Description
8
Spur A phase
Linear offset for Spur A phase.
Register 0x0505—Spur B
Table 137.
Bits
Bit Name
Description
7
HSR-B enable
Harmonic Spur Reduction B enable.
6
Amplitude gain × 2
[5:4]
Reserved
Reserved.
[3:0]
Spur B harmonic
Spur B Harmonic 1 to Spur B Harmonic 15.
Register 0x0506—Spur B (Continued)
Table 138.
Bits
Bit Name
Description
[7:0]
Spur B magnitude
Linear multiplier for Spur B magnitude.
Register 0x0508—Spur B (Continued)
Table 139.
Bits
Bit Name
Description
[7:0]
Spur B phase
Linear offset for Spur B phase.
Register 0x0509—Spur B (Continued)
Table 140.
Bits
Bit Name
Description
8
Spur B phase
Linear offset for Spur B phase.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| AD9550BCPZ-REEL7 | IC INTEGER-N TRANSLATOR 32-LFCSP |
| AD9551BCPZ | IC CLOCK GEN MULTISERV 40-LFCSP |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
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