參數(shù)資料
型號(hào)： AD9523-1BCPZ-REEL7
廠商： Analog Devices Inc
文件頁數(shù)： 38/60頁
文件大?。?/td> 0K
描述： IC INTEGER-N CLCK GEN 72LFCSP
標(biāo)準(zhǔn)包裝： 400
類型： 時(shí)鐘/頻率發(fā)生器，扇出緩沖器（分配），多路復(fù)用器
PLL： 是
主要目的： 以太網(wǎng)，光纖通道，SONET/SDH
輸入： CMOS
輸出： HSTL，LVCMOS，LVDS，LVPECL
電路數(shù)： 1
比率 - 輸入:輸出： 2:14
差分 - 輸入:輸出： 是/是
頻率 - 最大： 1GHz
電源電壓： 1.768 V ~ 3.465 V
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 72-VFQFN 裸露焊盤，CSP
供應(yīng)商設(shè)備封裝： 72-LFCSP
包裝： 帶卷 (TR)
配用： AD9523/PCBZ-ND - BOARD EVAL FOR AD9523
AD9523-1
Rev. B | Page 43 of 60
Addr
(Hex)
Register
Name
(MSB)
Bit 7
Bit 6
Bit 5
Bit 4
Bit 3
Bit 2
Bit 1
(LSB)
Bit 0
Default
Value
(Hex)
Other
0x230
Reserved
Status Monitor 0 control
0x00
0x231
Reserved
Status Monitor 1 control
0x00
0x232
Status signals
Reserved
Enable Status_
EEPROM on
STATUS0 pin
STATUS1
pin
divider
enable
STATUS0
pin
divider
enable
Reserved
Sync dividers
(manual
control)
0: sync signal
inactive
1: dividers
held in sync
(same as
SYNC pin low)
0x00
0x233
Power-down
control
Reserved
PLL1
power-
down
PLL2
power-down
Distribution
power-down
0x07
0x234
Update all
registers
Reserved
IO_Update
0x00
EEPROM Buffer
0xA00
Instruction (data)[7:0] (serial port configuration register)
0x00
0xA01
High byte of register address (serial port configuration register)
0x00
0xA02
EEPROM
Buffer Segment
Register 1 to
EEPROM
Buffer Segment
Register 3
Low byte of register address (serial port configuration register)
0x00
0xA03
Instruction (data)[7:0] (reaback control register)
0x02
0xA04
High byte of register address (reaback control register)
0x00
0xA05
EEPROM
Buffer Segment
Register 4 to
EEPROM
Buffer Segment
Register 6
Low byte of register address (reaback control register)
0x04
0xA06
Instruction (data)[7:0] (PLL segment)
0x0E
0xA07
High byte of register address (PLL segment)
0x00
0xA08
EEPROM
Buffer Segment
Register 7 to
EEPROM
Buffer Segment
Register 9
Low byte of register address (PLL segment)
0x10
0xA09
Instruction (data)[7:0] (PECL/CMOS output segment)
0x0E
0xA0A
High byte of register address (PECL/CMOS output segment)
0x00
0xA0B
EEPROM
Buffer Segment
Register 10 to
EEPROM
Buffer Segment
Register 12
Low byte of register address (PECL/CMOS output segment)
0xF0
0xA0C
Instruction (data)[7:0] (divider segment)
0x2B
0xA0D
High byte of register address (divider segment)
0x01
0xA0E
EEPROM
Buffer Segment
Register 13 to
EEPROM
Buffer Segment
Register 15
Low byte of register address (divider segment)
0x90
0xA0F
Instruction (data)[7:0] (clock input and REF segment)
0x01
0xA10
High byte of register address (clock input and REF segment)
0x01
0xA11
EEPROM
Buffer Segment
Register 16 to
EEPROM
Buffer Segment
Register 18
Low byte of register address (clock input and REF segment)
0xE0
0xA12
Instruction (data)[7:0] (other segment)
0x03
0xA13
High byte of register address (other segment)
0x02
0xA14
EEPROM
Buffer Segment
Register 19 to
EEPROM
Buffer Segment
Register 21
Low byte of register address (other segment)
0x30
0xA15
EEPROM
Buffer Segment
Register 22
I/O update
0x80
相關(guān)PDF資料
PDF描述
AD9523BCPZ IC INTEGER-N CLCK GEN 72LFCSP
AD9524BCPZ IC INTEGER-N CLCK GEN 48LFCSP
AD9540BCPZ-REEL7 IC CLOCK GEN/SYNTHESIZER 48LFCSP
AD9547BCPZ-REEL7 IC CLOCK GEN/SYNCHRONIZR 64LFCSP
AD9548BCPZ-REEL7 IC CLOCK GEN/SYNCHRONIZR 88LFCSP
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參數(shù)描述
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