Revision 13 2-115 DDR Module Specifications Input DDR Module Figure 2-31 Input DDR Timing Model " />
參數(shù)資料
型號： A3P250L-1VQ100I
廠商： Microsemi SoC
文件頁數(shù)： 37/242頁
文件大小： 0K
描述： IC FPGA 1KB FLASH 250K 100-VQFP
標準包裝： 90
系列： ProASIC3L
RAM 位總計： 36864
輸入/輸出數(shù)： 68
門數(shù)： 250000
電源電壓： 1.14V ~ 1.575 V
安裝類型： 表面貼裝
工作溫度： -40°C ~ 85°C
封裝/外殼： 100-TQFP
供應(yīng)商設(shè)備封裝： 100-VQFP（14x14）
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ProASIC3L Low Power Flash FPGAs
Revision 13
2-115
DDR Module Specifications
Input DDR Module
Figure 2-31 Input DDR Timing Model
Table 2-194 Parameter Definitions
Parameter Name
Parameter Definition
Measuring Nodes (from, to)
tDDRICLKQ1
Clock-to-Out Out_QR
B, D
tDDRICLKQ2
Clock-to-Out Out_QF
B, E
tDDRISUD
Data Setup Time of DDR input
A, B
tDDRIHD
Data Hold Time of DDR input
A, B
tDDRICLR2Q1
Clear-to-Out Out_QR
C, D
tDDRICLR2Q2
Clear-to-Out Out_QF
C, E
tDDRIREMCLR
Clear Removal
C, B
tDDRIRECCLR
Clear Recovery
C, B
Input DDR
Data
CLK
CLKBUF
INBUF
Out_QF
(to core)
FF2
FF1
INBUF
CLR
DDR_IN
E
A
B
C
D
Out_QR
(to core)
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