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參數(shù)資料
| 型號： | a16450 |
| 廠商： | Altera Corporation |
| 英文描述： | Universal Asynchronous Receiver/Transmitter(通用異步接收/傳送器) |
| 中文描述： | 通用異步接收器/發(fā)送器（通用異步接收/傳送器） |
| 文件頁數(shù)： | 5/16頁 |
| 文件大小： | 281K |
| 代理商： | A16450 |
Altera Corporation
69
a16450 Universal Asynchronous Receiver/Transmitter Data Sheet
Register Address Map
The state of the
a[2..0]
inputs determines which internal register the
microprocessor addresses. See
Table 2
.
The divisor register access bit (
drab
) allows access to the divisor register.
The
drab
is bit 7 of the line control register.
Note:
(1)
The X indicates “don’t care.”
Registers
The
a16450
MegaCore function contains the following registers:
I
I
I
I
I
I
I
I
I
I
Receiver buffer
Transmitter holding
Divisor
Interrupt enable
Interrupt identification
Line control
Modem control
Line status
Modem status
Scratchpad
Table 2. Register Address Map
drab
(1)
a2
a1
a0
Register
0
0
0
0
Receiver buffer register—read only
Transmitter holding register—write only
Divisor register (LSB)
Interrupt enable register
Divisor register (MSB)
Interrupt ID register
Line control register
Modem control register
Line status register
Modem status register
Scratchpad register
1
0
1
X
X
X
X
X
X
0
0
0
0
0
1
1
1
1
0
0
0
1
1
0
0
1
1
0
1
1
0
1
0
1
0
1
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