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參數(shù)資料
| 型號： | 935269343557 |
| 廠商： | NXP SEMICONDUCTORS |
| 元件分類： | 消費(fèi)家電 |
| 英文描述： | SPECIALTY CONSUMER CIRCUIT, PQFP160 |
| 封裝： | 28 X 28 MM, 3.40 MM HEIGHT, ROHS COMPLIANT, PLASTIC, SOT322-2, MS-022, QFP-160 |
| 文件頁數(shù)： | 65/143頁 |
| 文件大小： | 696K |
| 代理商： | 935269343557 |
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2004 Aug 25
28
Philips Semiconductors
Product specication
Multimedia bridge, high performance
Scaler and PCI circuit (SPCI)
SAA7146A
Table 11 Main control register 2
OFFSET
(HEX)
NAME
BIT
TYPE
DESCRIPTION
Mask word
100
M15 to M00
31 to 16 RW
16-bit mask word for bit-selective writes to the control word; when
read this bits always returns logic 0
Control word
100
RPS_SIG4
15
RW
RPS Signal 4
RPS_SIG3
14
RW
RPS Signal 3
RPS_SIG2
13
RW
RPS Signal 2
RPS_SIG1
12
RW
RPS Signal 1
RPS_SIG0
11
RW
RPS Signal 0
UPLD_D1_B
10
RW
Upload ‘Video DATA stream handling at port D1_B (54H)’; see
Table 68. To upload ‘Initial setting of Dual D1 Interface (50H)’, this
bit and bit 9 must be set; see Table 66.
UPLD_D1_A
9
RW
Upload ‘Video DATA stream handling at port D1_A (54H)’; see
Table 67. To upload ‘Initial setting of Dual D1 Interface (50H)’, this
bit and bit 10 must be set; see Table 66.
UPLD_BRS
8
RW
Upload ‘BRS Control Register (58H)’; see Table 69.
7
Reserved; when read this bit always returns a logic 0.
UPLD_HPS_H
6
RW
Upload ‘HPS Horizontal prescale (68H)’; see Table 79.
Upload ‘HPS Horizontal ne-scale (6CH)’; see Table 81.
Upload ‘BCS control (70H)’; see Table 82.
UPLD_HPS_V
5
RW
Upload ‘HPS control (5CH)’; see Table 71.
Upload ‘HPS Vertical scale (60H)’; see Table 72.
Upload ‘HPS Vertical scale and gain (64H)’; see Table 73.
Upload ‘Chroma Key range (74H)’; see Table 86.
Upload ‘HPS Outputs and Formats (78H)’; see Table 87.
Upload ‘Clip control (78H)’; see Table 89.
UPLD_DMA3
4
RW
Upload ‘Video DMA3 registers’; 30H, 34H, 38H, 3CH, 40H, 44H
and 48H (20 to 16).
UPLD_DMA2
3
RW
Upload ‘Video DMA2 registers’; 18H, 1CH, 20H, 24H, 28H, 2CH
and 48H (12 to 8).
UPLD_DMA1
2
RW
Upload ‘Video DMA1 registers’; 00H, 04H, 08H, 0CH, 10H, 14H
and 48H (4 to 0).
UPLD_DEBI
1
RW
Upload ‘DEBI registers’; 88H, 7CH, 80H, 84H and 48H (28 to 26).
UPLD_IIC
0
RW
Upload ‘I2C-bus registers’; (8CH and 90H).
相關(guān)PDF資料 |
PDF描述 |
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| 935269480115 | 0.3 A SWITCHING REGULATOR, 57.5 kHz SWITCHING FREQ-MAX, PDSO5 |
| 935269479115 | 0.3 A SWITCHING REGULATOR, 57.5 kHz SWITCHING FREQ-MAX, PDSO5 |
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參數(shù)描述 |
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| 935270713557 | 制造商:NXP Semiconductors 功能描述:SUB ONLY IC CHP |
| 935270792551 | 制造商:NXP Semiconductors 功能描述:IC BUFF DVR TRI-ST 16BIT 56VFBGA |
| 935270792557 | 制造商:NXP Semiconductors 功能描述:IC BUFF DVR TRI-ST 16BIT 56VFBGA |
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