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參數(shù)資料
| 型號： | 935269343557 |
| 廠商： | NXP SEMICONDUCTORS |
| 元件分類： | 消費家電 |
| 英文描述： | SPECIALTY CONSUMER CIRCUIT, PQFP160 |
| 封裝： | 28 X 28 MM, 3.40 MM HEIGHT, ROHS COMPLIANT, PLASTIC, SOT322-2, MS-022, QFP-160 |
| 文件頁數(shù)： | 33/143頁 |
| 文件大?。?/td> | 696K |
| 代理商： | 935269343557 |
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2004 Aug 25
128
Philips Semiconductors
Product specication
Multimedia bridge, high performance
Scaler and PCI circuit (SPCI)
SAA7146A
VOH
HIGH-level output voltage
clocks
2.6
VDDD
V
other outputs;
note 2
2.4
VDDD
V
I2C-bus, pins SDA and SCL
VIL
LOW-level input voltage
(VDDI2C related input levels)
note 3
0.5
+0.3VDDI2C
V
VIH
HIGH-level input voltage
(VDDI2C related input levels)
note 3
0.7VDDI2C
VDDI2C + 0.5
V
Vhys
hysteresis of Schmitt trigger
inputs (VDDI2C related input levels)
note 3
0.05VDDI2C
V
VOL1
LOW-level output voltage
(open-drain or open-collector)
at 3 mA sink
current
0
0.4
V
VOL2
LOW-level output voltage
(open-drain or open-collector)
at 6 mA sink
current
0
0.6
V
to(f)
output fall time from VIHmin to
VILmax with a bus capacitance
from 10 to 400 pF
note 4
up to 3 mA sink
current at VOL1
20 + 0.1Cb
250
ns
up to 3 mA sink
current at VOL2
20 + 0.1Cb
250
ns
Ii
input current each I/O pin with an
input voltage between 0.4 and
0.9VDDi2Cmax
note 3
+10(5)
A
Ci
capacitance for each I/O pin
10
pF
Clock input timing (LLC_A and LLC_B); see Fig.46
tLLC_A,
tLLC_B
cycle time
31
45
ns
δ
duty factor
tLLCH/tLLC
40
50
60
%
tr
rise time
5ns
tf
fall time
6ns
Data and control input timing; see Fig.46
tSU
set-up time
6
ns
tHD
hold time
3
ns
Clock output timing (LLC_A, LLC_B); see Fig.46
CL
output load capacitance
15
40
pF
tLLC_A,
tLLC_B
cycle time
31
45
ns
δ
duty factor
tLLCH/tLLC
40
50
60
%
tr
rise time
0.6 to 2.6 V
5ns
tf
fall time
2.6 to 0.6 V
5ns
Data and control output timing; see Fig.46
CL
load capacitance
15
40
pF
tOH
output hold time
CL =15pF
4
ns
SYMBOL
PARAMETER
CONDITIONS
MIN.
TYP.
MAX.
UNIT
相關(guān)PDF資料 |
PDF描述 |
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參數(shù)描述 |
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| 935270792557 | 制造商:NXP Semiconductors 功能描述:IC BUFF DVR TRI-ST 16BIT 56VFBGA |
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