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參數(shù)資料
| 型號： | 82801AA |
| 廠商： | INTEL CORP |
| 元件分類： | 外設及接口 |
| 英文描述： | 82801AB (ICH0) I/O Controller Hub |
| 中文描述： | MULTIFUNCTION PERIPHERAL, PBGA241 |
| 封裝： | BGA-241 |
| 文件頁數(shù)： | 340/462頁 |
| 文件大小： | 3450K |
| 代理商： | 82801AA |
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IDE Controller Registers (D31:F1)
10-8
Intel
82801BA ICH2 Datasheet
10.1.12
SDMA_CNT—Synchronous DMA Control Register
(IDE—D31:F1)
Address Offset:
Default Value:
48h
00h
Attribute:
Size:
R/W
8 bits
10.1.13
SDMA_TIM—Synchronous DMA Timing Register
(IDE—D31:F1)
Address Offset:
Default Value:
4A–4Bh
0000h
Attribute:
Size:
R/W
16 bits
Bit
Description
7:4
Reserved.
3
Secondary Drive 1 Synchronous DMA Mode Enable (SSDE1)—
R/W.
0 = Disable (default).
1 = Enable Synchronous DMA mode for secondary channel drive 1
2
Secondary Drive 0 Synchronous DMA Mode Enable (SSDE0)—
R/W.
0 = Disable (default).
1 = Enable Synchronous DMA mode for secondary drive 0.
1
Primary Drive 1 Synchronous DMA Mode Enable (PSDE1)—
R/W.
0 = Disable (default).
1 = Enable Synchronous DMA mode for primary channel drive 1
0
Primary Drive 0 Synchronous DMA Mode Enable (PSDE0)—
R/W.
0 = Disable (default).
1 = Enable Synchronous DMA mode for primary channel drive 0
Bit
Description
15:14
Reserved.
13:12
Secondary Drive 1 Cycle Time (SCT1)—
R/W. For Ultra ATA mode, the setting of these bits
determines the minimum write strobe cycle time (CT). The DMARDY#-to-STOP (RP) time is also
determined by the setting of these bits.
SCB1 = 0 (33 MHz clk)
SCB1 = 1 (66 MHz clk)
00 = CT 4 clocks, RP 6 clocks
00 = Reserved
01 = CT 3 clocks, RP 5 clocks
01 = CT 3 clocks, RP 8 clocks
10 = CT 2 clocks, RP 4 clocks
10 = CT 2 clocks, RP 8 clocks
11 = Reserved
11 = Reserved
FAST_SCB1 = 1 (133 MHz clk)
00 = Reserved
01 = CT 3 clks, RP 16 clks
10 = Reserved
11 = Reserved
11:10
Reserved.
9:8
Secondary Drive 0 Cycle Time (SCT0)—
R/W. For Ultra ATA mode, the setting of these bits
determines the minimum write strobe cycle time (CT). The DMARDY#-to-STOP (RP) time is also
determined by the setting of these bits.
SCB1 = 0 (33 MHz clk)
SCB1 = 1 (66 MHz clk)
00 = CT 4 clocks, RP 6 clocks
00 = Reserved
01 = CT 3 clocks, RP 5 clocks
01 = CT 3 clocks, RP 8 clocks
10 = CT 2 clocks, RP 4 clocks
10 = CT 2 clocks, RP 8 clocks
11 = Reserved
11 = Reserved
FAST_SCB1 = 1 (133 MHz clk)
00 = Reserved
01 = CT 3 clks, RP 16 clks
10 = Reserved
11 = Reserved
7:6
Reserved.
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相關PDF資料 |
PDF描述 |
|---|---|
| 82801AB | 82801AB (ICH0) I/O Controller Hub |
| 82803AAMRH-R | Controller Miscellaneous - Datasheet Reference |
| 82804AA | Interface IC |
| 82805AA | Interface IC |
| 82806AA | Interface IC |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
| 82801AASL3Z2 | 制造商: 功能描述: 制造商:Intel 功能描述: 制造商:undefined 功能描述: |
| 82801AB | 制造商:INTEL 制造商全稱:Intel Corporation 功能描述:82801AB (ICH0) I/O Controller Hub |
| 82801BA | 制造商:INTEL 制造商全稱:Intel Corporation 功能描述:Intel 82801BA I/O Controller Hub 2 (ICH2) and Intel 82801BAM I/O Controller Hub 2 Mobile |
| 82801BAICH2 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:PERIPHERAL (MULTIFUNCTION) CONTROLLER |
| 82801DB | 制造商:INTEL 制造商全稱:Intel Corporation 功能描述:Intel 82801DB I/O Controller Hub 4 (ICH4) |
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