參數(shù)資料
型號： 5AGXMB3G6F31C6NES
廠商： Altera
文件頁數(shù)： 31/124頁
文件大小： 0K
描述： IC ARRIA V FPGA 362K 896FBGA
標(biāo)準(zhǔn)包裝： 3
系列： Arria V GX
LAB/CLB數(shù)： 17110
邏輯元件/單元數(shù)： 362730
RAM 位總計(jì)： 2148352
輸入/輸出數(shù)： 384
電源電壓： 1.07 V ~ 1.13 V
安裝類型： 表面貼裝
工作溫度： 0°C ~ 85°C
封裝/外殼： 896-BGA
供應(yīng)商設(shè)備封裝： 896-FBGA（31x31）
其它名稱： 544-2735
Page 12
Electrical Characteristics
Arria V GX, GT, SX, and ST Device Datasheet
February 2014
Altera Corporation
Internal Weak Pull-Up Resistor
Table 13 lists the weak pull-up resistor values for Arria V devices.
All I/O pins have an option to enable weak pull-up except the configuration, test, and
JTAG pins. For more information about the pins that support internal weak pull-up
and internal weak pull-down features, refer to the Arria V GT, GX, ST, and SX Device
I/O Standard Specifications
Table 14 through Table 19 list the input voltage (VIH and VIL), output voltage (VOH and
VOL), and current drive characteristics (IOH and IOL) for various I/O standards
supported by Arria V devices.
For an explanation of terms used in Table 14 through Table 19, refer to “Glossary” on
Table 13. Internal Weak Pull-Up Resistor Values for Arria V Devices
Symbol
Description
Conditions (V) (1)
Value (2)
Unit
RPU
Value of the I/O pin pull-up resistor before and during
configuration, as well as user mode if you have enabled the
programmable pull-up resistor option.
VCCIO = 3.3 ±5%
25
k
Ω
VCCIO = 3.0 ±5%
25
k
Ω
VCCIO = 2.5 ±5%
25
k
Ω
VCCIO = 1.8 ±5%
25
k
Ω
VCCIO = 1.5 ±5%
25
k
Ω
VCCIO = 1.35 ±5%
25
k
Ω
VCCIO = 1.25 ±5%
25
k
Ω
VCCIO = 1.2 ±5%
25
k
Ω
Notes to Table 13:
(1) Pin pull-up resistance values may be lower if an external source drives the pin higher than VCCIO.
(2) Valid with ±10% tolerances to cover changes over PVT.
Table 14. Single-Ended I/O Standards for Arria V Devices (Part 1 of 2)
I/O Standard
VCCIO (V)
VIL (V)
VIH (V)
VOL (V)
VOH (V)
IOL (1)
(mA)
IOH (1)
(mA)
Min
Typ
Max
Min
Max
Min
Max
Min
3.3-V LVTTL
3.135
3.3
3.465
–0.3
0.8
1.7
3.6
0.45
2.4
4
–4
3.3-V
LVCMOS
3.135
3.3
3.465
–0.3
0.8
1.7
3.6
0.2
VCCIO – 0.2
2
–2
3.0-V LVTTL
2.85
3
3.15
–0.3
0.8
1.7
3.6
0.4
2.4
2
–2
3.0-V
LVCMOS
2.85
3
3.15
–0.3
0.8
1.7
3.6
0.2
VCCIO – 0.2
0.1
–0.1
3.0-V PCI
2.85
3
3.15
—
0.3 x VCCIO
0.5 x VCCIO
VCCIO + 0.3
0.1 x VCCIO
0.9 x VCCIO
1.5
–0.5
3.0-V PCI-X
2.85
3
3.15
—
0.35 x VCCIO
0.5 x VCCIO
VCCIO + 0.3
0.1 x VCCIO
0.9 x VCCIO
1.5
–0.5
2.5 V
2.375
2.5
2.625
–0.3
0.7
1.7
3.6
0.4
2
1
–1
1.8 V
1.71
1.8
1.89
–0.3
0.35 x VCCIO
0.65 x
VCCIO
VCCIO + 0.3
0.45
VCCIO – 0.45
2
–2
1.5 V
1.425
1.5
1.575
–0.3
0.35 x VCCIO
0.65 x
VCCIO
VCCIO + 0.3
0.25 x VCCIO
0.75 x VCCIO
2–2
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PDF描述
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5AGXMB5G4F35C5N 功能描述:FPGA - 現(xiàn)場可編程門陣列 FPGA - Arria V GX 15849 LABs 544 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內(nèi)嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-256
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