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參數(shù)資料
| 型號： | 5962F9855202QXA |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 32-BIT, 16 MHz, RISC MICROCONTROLLER, CPGA144 |
| 封裝： | CERAMIC, PGA-144 |
| 文件頁數(shù)： | 6/64頁 |
| 文件大?。?/td> | 1464K |
| 代理商： | 5962F9855202QXA |
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14
Interrupt Mask Register
The Interrupt Mask Register (MK) contains one mask bit for
each of the 15 system interrupts. All bits in the MK are set or
reset under software control, setting bits 15 and 10 has no effect
on the UT69R000’s interrupt operation because these interrupts
cannot be masked. The UT69R000 reads and writes the MK
with instructions OTR Rd,MK and INR Rd,MK. A logical one
unmasks an interrupt; logic zero masks an interrupt.
Bit Number
Mnemonic
Description
Bit 15
PWDN
Non-Maskable Interrupt
Bit 14
MCHE
Machine Error Interrupt
Bit 13
INT0
External Interrupt 0
Bit 12
FLPO
Software Interrupt 3
Bit 11
FIPO
Fix Point Overflow
Bit 10
EXCL
Software Interrupt 2
Bit 9
FLPN
Software Interrupt 1
Bit 8
TIMA
Timer A Interrupt
Bit 7
INT1
External Interrupt 1
Bit 6
TIMB
Timer B Interrupt
Bit 5
INT2
External Interrupt 2
Bit 4
INT3
External Interrupt 3
Bit 3
IOLI
External Interrupt 6
Bit 2
I0L2
External Interrupt 4
Bit 1
INT7
External Interrupt 7
Bit 0
NU
Not Used (see Note on page 11)
15 14 13 12 11 10 9
8
7
5
4
3 2
1 0
P
W
D
N
M
C
H
E
I
N
T
O
F
L
P
O
F
I
P
O
E
X
C
L
F
L
P
T
I
M
6
T
I
M
I
N
T
I
N
T
I
N
T
I
O
L
I
N
T
I
O
L
N
/
U
MSB
LSB
Figure 13. The Interrupt Mask Register (MK)
UA
B
12
3
1 4
2
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PDF描述 |
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