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參數(shù)資料
| 型號： | XRT94L31IB |
| 廠商： | Exar Corporation |
| 文件頁數(shù)： | 27/133頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC MAPPER DS3/E3/STS-1 504TBGA |
| 標準包裝： | 24 |
| 應(yīng)用： | 網(wǎng)絡(luò)切換 |
| 接口： | 總線 |
| 電源電壓： | 3.14 V ~ 3.47 V |
| 封裝/外殼： | 504-LBGA |
| 供應(yīng)商設(shè)備封裝： | 504-TBGA（35x35） |
| 包裝： | 托盤 |
| 安裝類型： | 表面貼裝 |
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XRT94L31
122
3-CHANNEL DS3/E3/STS-1 TO STS-3/STM-1 MAPPER IC
REV. 1.0.1
NOTE: The values for t23 and t24 can be found in
1.9
TRANSMIT LINE DCC INSERTION INPUT PORT
The Transmit Section DCC Insertion Input Port provides a dedicated port for the user to insert his/her own
value for the D4 through D12 bytes within the outbound STS-3/STM-1 data-stream. The user should note that
the TxLDCC input pin is sampled (by the Transmit Section DCC Insertion Input Port) upon the rising edge of
TxTOHClk. The TxLDCCEnable output signal is updated upon the falling edge of TxTOHClk. The timing
wave-form and information for the Transmit Line DCC Insertion Input Port is presented below.
FIGURE 25. ILLUSTRATION OF THE TIMING WAVE-FORM OF THE TRANSMIT SECTION DCC OVERHEAD INSERTION
PORT
TABLE 26: TIMING INFORMATION FOR THE TRANSMIT ORDER-WIRE BYTE OVERHEAD INPUT PORT
SYMBOL
DESCRIPTION
MIN.
TYP.
MAX.
t23
Falling edge of TxTOHClk to rising edge of TxSDCCEnable output delay
-0.4ns
0.1ns
t24
TxSDCC Data to rising edge of TxTOHClk set-up time
4ns
TxSDCC
TxSDCCEnb
TxTOHClk
t23
t24
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