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參數(shù)資料
| 型號： | XC912BC32CFUE8 |
| 廠商： | Freescale Semiconductor |
| 文件頁數(shù)： | 52/334頁 |
| 文件大?。?/td> | 0K |
| 描述： | MCU 16BIT 32K FLASH 80-QFP |
| 標準包裝： | 84 |
| 系列： | HC12 |
| 核心處理器： | CPU12 |
| 芯體尺寸： | 16-位 |
| 速度： | 8MHz |
| 連通性： | SCI，SPI |
| 外圍設備： | POR，PWM，WDT |
| 輸入/輸出數(shù)： | 63 |
| 程序存儲器容量： | 32KB（32K x 8） |
| 程序存儲器類型： | 閃存 |
| EEPROM 大?。?/td> | 768 x 8 |
| RAM 容量： | 1K x 8 |
| 電壓 - 電源 (Vcc/Vdd)： | 4.5 V ~ 5.5 V |
| 數(shù)據(jù)轉(zhuǎn)換器： | A/D 8x10b |
| 振蕩器型： | 外部 |
| 工作溫度： | -40°C ~ 85°C |
| 封裝/外殼： | 80-QFP |
| 包裝： | 托盤 |
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Block Diagram
M68HC12B Family Data Sheet, Rev. 9.1
Freescale Semiconductor
145
TSBCK — Timer Stops While in Background Mode Bit
0 = Allows timer to continue running while in background mode
1 = Disables timer when MCU is in background mode; useful for emulation
TFFCA — Timer Fast Flag Clear All Bit
0 = Allows timer flag clearing to function normally
1 = For TFLG1($8E), a read from an input capture or a write to the output compare channel
($90–$9F) causes the corresponding channel flag, CnF, to be cleared. For TFLG2 ($8F), any
access to the TCNT register ($84, $85) clears the TOF flag. Any access to the PACNT register
($A2 and $A3) clears the PAOVF and PAIF flags in the PAFLG register ($A1).
This has the advantage of eliminating software overhead in a separate clear sequence.
NOTE
Extra care is required to avoid accidental flag clearing due to unintended
accesses.
12.3.6 Timer Control Registers
Read: Anytime
Write: Anytime
OMn — Output mode
OLn — Output level
These eight pairs of control bits are encoded to specify the output action to be taken as a result of a
successful OCn compare (see Table 12-1). When either OMn or OLn is 1, the pin associated with OCn
becomes an output tied to OCn regardless of the state of the associated DDRT bit.
Address: $0088
Bit 7
654321
Bit 0
Read:
OM7OL7
OM6OL6
OM5OL5
OM4OL4
Write:
Reset:
00000000
Figure 12-8. Timer Control Register 1 (TCTL1)
Address: $0089
Bit 7
654321
Bit 0
Read:
OM3OL3
OM2OL2
OM1OL1
OM0OL0
Write:
Reset:
00000000
Figure 12-9. Timer Control Register 2 (TCTL2)
Table 12-1. Compare Result Output Action
OMn
OLn
Action
0
Timer disconnected from output pin logic
0
1
Toggle OCn output line
1
0
Clear OCn output line to 0
1
Set OCn output line to 1
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