參數(shù)資料
型號： XC3S500E-5FGG320C
廠商： Xilinx Inc
文件頁數(shù)： 68/227頁
文件大?。?/td> 0K
描述： IC FPGA SPARTAN-3E 500K 320-FBGA
標準包裝： 84
系列： Spartan®-3E
LAB/CLB數(shù)： 1164
邏輯元件/單元數(shù)： 10476
RAM 位總計： 368640
輸入/輸出數(shù)： 232
門數(shù)： 500000
電源電壓： 1.14 V ~ 1.26 V
安裝類型： 表面貼裝
工作溫度： 0°C ~ 85°C
封裝/外殼： 320-BGA
供應(yīng)商設(shè)備封裝： 320-FBGA（19x19）
配用： 122-1536-ND - KIT STARTER SPARTAN-3E
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Spartan-3E FPGA Family: Functional Description
DS312 (v4.1) July 19, 2013
Product Specification
16
Spartan-3E FPGAs provide additional input flexibility by
allowing I/O standards to be mixed in different banks. For a
particular VCCO voltage, Table 6 and Table 7 list all of the
IOSTANDARDs that can be combined and if the
IOSTANDARD is supported as an input only or can be used
for both inputs and outputs.
Table 6: Single-Ended IOSTANDARD Bank Compatibility
Single-Ended
IOSTANDARD
VCCO Supply/Compatibility
Input Requirements
1.2V
1.5V
1.8V
2.5V
3.3V
VREF
Board
Termination
Voltage (VTT)
LVTTL
-
Input/
Output
N/R
LVCMOS33
-
Input/
Output
N/R
LVCMOS25
-
Input/
Output
Input
N/R
LVCMOS18
-
Input/
Output
Input
N/R
LVCMOS15
-
Input/
Output
Input
N/R
LVCMOS12
Input/
Output
Input
N/R
PCI33_3
-
Input/
Output
N/R
PCI66_3
-
Input/
Output
N/R
HSTL_I_18
-
Input/
Output
Input
0.9
HSTL_III_18
-
Input/
Output
Input
1.1
1.8
SSTL18_I
-
Input/
Output
Input
0.9
SSTL2_I
-
Input/
Output
Input
1.25
Notes:
1.
N/R - Not required for input operation.
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