參數(shù)資料
型號： XC3S500E-5FGG320C
廠商： Xilinx Inc
文件頁數(shù)： 107/227頁
文件大小： 0K
描述： IC FPGA SPARTAN-3E 500K 320-FBGA
標準包裝： 84
系列： Spartan®-3E
LAB/CLB數(shù)： 1164
邏輯元件/單元數(shù)： 10476
RAM 位總計： 368640
輸入/輸出數(shù)： 232
門數(shù)： 500000
電源電壓： 1.14 V ~ 1.26 V
安裝類型： 表面貼裝
工作溫度： 0°C ~ 85°C
封裝/外殼： 320-BGA
供應(yīng)商設(shè)備封裝： 320-FBGA（19x19）
配用： 122-1536-ND - KIT STARTER SPARTAN-3E
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Spartan-3E FPGA Family: Pinout Descriptions
DS312 (v4.1) July 19, 2013
Product Specification
195
Footprint Migration Differences
Table 147 summarizes any footprint and functionality
differences between the XC3S250E, the XC3S500E, and
the XC3S1200E FPGAs that may affect easy migration
between devices in the FG256 package. There are 26 such
balls. All other pins not listed in Table 147 unconditionally
migrate between Spartan-3E devices available in the FT256
package.
The XC3S250E is duplicated on both the left and right sides
of the table to show migrations to and from the XC3S500E
and the XC3S1200E. The arrows indicate the direction for
easy migration. A double-ended arrow (
) indicates that
the two pins have identical functionality. A left-facing arrow
(
) indicates that the pin on the device on the right
unconditionally migrates to the pin on the device on the left.
It may be possible to migrate the opposite direction
depending on the I/O configuration. For example, an I/O pin
(Type = I/O) can migrate to an input-only pin
(Type = INPUT) if the I/O pin is configured as an input.
Table 147: FT256 Footprint Migration Differences
FT256
Ball
Bank
XC3S250E
Type
Migration
XC3S500E Type
Migration
XC3S1200E Type
Migration
XC3S250E
Type
B6
0
INPUT
INPUT
I/O
INPUT
B7
0
N.C.
I/O
I/O
N.C.
B10
0
INPUT
INPUT
I/O
INPUT
C7
0
N.C.
I/O
I/O
N.C.
D16
1
VREF(I/O)
VREF(INPUT)
VREF(INPUT)
VREF(I/O)
E13
1
N.C.
I/O
I/O
N.C.
E16
1
N.C.
I/O
I/O
N.C.
F3
3
N.C.
I/O
I/O
N.C.
F4
3
N.C.
VREF
VREF
N.C.
F5
3
I/O
I/O
INPUT
I/O
L2
3
N.C.
VREF
VREF
N.C.
L3
3
N.C.
I/O
I/O
N.C.
L4
3
N.C.
I/O
I/O
N.C.
L12
1
N.C.
I/O
I/O
N.C.
L13
1
N.C.
I/O
I/O
N.C.
M4
3
N.C.
I/O
I/O
N.C.
M7
2
INPUT
INPUT
I/O
INPUT
M14
1
I/O
I/O
INPUT
I/O
N2
3
VREF(I/O)
VREF(I/O)
VREF(INPUT)
VREF(I/O)
N7
2
N.C.
I/O
I/O
N.C.
N14
1
N.C.
I/O
I/O
N.C.
N15
1
N.C.
VREF
VREF
N.C.
P7
2
N.C.
I/O
I/O
N.C.
P10
2
N.C.
I/O
I/O
N.C.
R10
2
N.C.
VREF
VREF
N.C.
T12
2
INPUT
INPUT
I/O
INPUT
DIFFERENCES
19
7
26
Legend:
This pin is identical on the device on the left and the right.
This pin can unconditionally migrate from the device on the left to the device on the right. Migration in the other direction may be
possible depending on how the pin is configured for the device on the right.
This pin can unconditionally migrate from the device on the right to the device on the left. Migration in the other direction may be
possible depending on how the pin is configured for the device on the left.
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