參數(shù)資料
型號(hào)： XC3S500E-4FT256I
廠商： Xilinx Inc
文件頁(yè)數(shù)： 91/227頁(yè)
文件大?。?/td> 0K
描述： IC FPGA SPARTAN 3E 256FTBGA
標(biāo)準(zhǔn)包裝： 90
系列： Spartan®-3E
LAB/CLB數(shù)： 1164
邏輯元件/單元數(shù)： 10476
RAM 位總計(jì)： 368640
輸入/輸出數(shù)： 190
門數(shù)： 500000
電源電壓： 1.14 V ~ 1.26 V
安裝類型： 表面貼裝
工作溫度： -40°C ~ 100°C
封裝/外殼： 256-LBGA
供應(yīng)商設(shè)備封裝： 256-FTBGA
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Spartan-3E FPGA Family: Pinout Descriptions
DS312 (v4.1) July 19, 2013
Product Specification
180
PQ208: 208-pin Plastic Quad Flat Package
The 208-pin plastic quad flat package, PQ208, supports two
different Spartan-3E FPGAs, including the XC3S250E and
the XC3S500E.
Table 141 lists all the PQ208 package pins. They are sorted
by bank number and then by pin name. Pairs of pins that
form a differential I/O pair appear together in the table. The
table also shows the pin number for each pin and the pin
type, as defined earlier.
An electronic version of this package pinout table and
footprint diagram is available for download from the Xilinx
website at:
Pinout Table
Table 141: PQ208 Package Pinout
Bank
XC3S250E
XC3S500E
Pin Name
PQ208
Pin
Type
0
IO
P187
I/O
0
IO/VREF_0
P179
VREF
0
IO_L01N_0
P161
I/O
0
IO_L01P_0
P160
I/O
0
IO_L02N_0/VREF_0
P163
VREF
0
IO_L02P_0
P162
I/O
0
IO_L03N_0
P165
I/O
0
IO_L03P_0
P164
I/O
0
IO_L04N_0/VREF_0
P168
VREF
0
IO_L04P_0
P167
I/O
0
IO_L05N_0
P172
I/O
0
IO_L05P_0
P171
I/O
0
IO_L07N_0/GCLK5
P178
GCLK
0
IO_L07P_0/GCLK4
P177
GCLK
0
IO_L08N_0/GCLK7
P181
GCLK
0
IO_L08P_0/GCLK6
P180
GCLK
0
IO_L10N_0/GCLK11
P186
GCLK
0
IO_L10P_0/GCLK10
P185
GCLK
0
IO_L11N_0
P190
I/O
0
IO_L11P_0
P189
I/O
0
IO_L12N_0/VREF_0
P193
VREF
0
IO_L12P_0
P192
I/O
0
IO_L13N_0
P197
I/O
0
IO_L13P_0
P196
I/O
0
IO_L14N_0/VREF_0
P200
VREF
0
IO_L14P_0
P199
I/O
0
IO_L15N_0
P203
I/O
0
IO_L15P_0
P202
I/O
0
IO_L16N_0/HSWAP
P206
DUAL
0
IO_L16P_0
P205
I/O
0
IP
P159
INPUT
0
IP
P169
INPUT
0
IP
P194
INPUT
0
IP
P204
INPUT
0
IP_L06N_0
P175
INPUT
0
IP_L06P_0
P174
INPUT
0
IP_L09N_0/GCLK9
P184
GCLK
0
IP_L09P_0/GCLK8
P183
GCLK
0
VCCO_0
P176
VCCO
0
VCCO_0
P191
VCCO
0
VCCO_0
P201
VCCO
1
IO_L01N_1/A15
P107
DUAL
1
IO_L01P_1/A16
P106
DUAL
1
IO_L02N_1/A13
P109
DUAL
1
IO_L02P_1/A14
P108
DUAL
1
IO_L03N_1/VREF_1
P113
VREF
1
IO_L03P_1
P112
I/O
1
IO_L04N_1
P116
I/O
1
IO_L04P_1
P115
I/O
1
IO_L05N_1/A11
P120
DUAL
1
IO_L05P_1/A12
P119
DUAL
1
IO_L06N_1/VREF_1
P123
VREF
1
IO_L06P_1
P122
I/O
1
IO_L07N_1/A9/RHCLK1
P127
RHCLK/DUAL
1
IO_L07P_1/A10/RHCLK0
P126
RHCLK/DUAL
1
IO_L08N_1/A7/RHCLK3
P129
RHCLK/DUAL
1
IO_L08P_1/A8/RHCLK2
P128
RHCLK/DUAL
1
IO_L09N_1/A5/RHCLK5
P133
RHCLK/DUAL
1
IO_L09P_1/A6/RHCLK4
P132
RHCLK/DUAL
1
IO_L10N_1/A3/RHCLK7
P135
RHCLK/DUAL
1
IO_L10P_1/A4/RHCLK6
P134
RHCLK/DUAL
1
IO_L11N_1/A1
P138
DUAL
1
IO_L11P_1/A2
P137
DUAL
1
IO_L12N_1/A0
P140
DUAL
1
IO_L12P_1
P139
I/O
1
IO_L13N_1
P145
I/O
1
IO_L13P_1
P144
I/O
1
IO_L14N_1
P147
I/O
1
IO_L14P_1
P146
I/O
Table 141: PQ208 Package Pinout (Cont’d)
Bank
XC3S250E
XC3S500E
Pin Name
PQ208
Pin
Type
相關(guān)PDF資料
PDF描述
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參數(shù)描述
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