參數(shù)資料
型號(hào)： XC3S250E-4CPG132I
廠商： Xilinx Inc
文件頁(yè)數(shù)： 97/227頁(yè)
文件大?。?/td> 0K
描述： IC FPGA SPARTAN-3E 250K 132CSBGA
標(biāo)準(zhǔn)包裝： 360
系列： Spartan®-3E
LAB/CLB數(shù)： 612
邏輯元件/單元數(shù)： 5508
RAM 位總計(jì)： 221184
輸入/輸出數(shù)： 92
門數(shù)： 250000
電源電壓： 1.14 V ~ 1.26 V
安裝類型： 表面貼裝
工作溫度： -40°C ~ 100°C
封裝/外殼： 132-TFBGA，CSPBGA
供應(yīng)商設(shè)備封裝： 132-CSPBGA（8x8）
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Spartan-3E FPGA Family: Pinout Descriptions
DS312 (v4.1) July 19, 2013
Product Specification
186
FT256: 256-ball Fine-pitch, Thin Ball Grid Array
The 256-ball fine-pitch, thin ball grid array package, FT256,
supports three different Spartan-3E FPGAs, including the
XC3S250E, the XC3S500E, and the XC3S1200E.
Table 143 lists all the package pins. They are sorted by
bank number and then by pin name of the largest device.
Pins that form a differential I/O pair appear together in the
table. The table also shows the pin number for each pin and
the pin type, as defined earlier.
The highlighted rows indicate pinout differences between
the XC3S250E, the XC3S500E, and the XC3S1200E
FPGAs. The XC3S250E has 18 unconnected balls,
indicated as N.C. (No Connection) in Table 143 and with the
black diamond character (
If the table row is highlighted in tan, then this is an instance
where an unconnected pin on the XC3S250E FPGA maps
to a VREF pin on the XC3S500E and XC3S1200E FPGA. If
the FPGA application uses an I/O standard that requires a
VREF voltage reference, connect the highlighted pin to the
VREF voltage supply, even though this does not actually
connect to the XC3S250E FPGA. This VREF connection on
the board allows future migration to the larger devices
without modifying the printed-circuit board.
All other balls have nearly identical functionality on all three
devices. Table 147 summarizes the Spartan-3E footprint
migration differences for the FT256 package.
An electronic version of this package pinout table and
footprint diagram is available for download from the Xilinx
web site at:
Pinout Table
Table 143: FT256 Package Pinout
Bank
XC3S250E Pin Name
XC3S500E Pin Name
XC3S1200E Pin Name
FT256
Ball
Type
0
IO
A7
I/O
0
IO
A12
I/O
0
IO
B4
I/O
0
IP
IO
B6
250E: INPUT
500E: INPUT
1200E: I/O
0
IP
IO
B10
250E: INPUT
500E: INPUT
1200E: I/O
0
IO/VREF_0
D9
VREF
0
IO_L01N_0
A14
I/O
0
IO_L01P_0
B14
I/O
0
IO_L03N_0/VREF_0
A13
VREF
0
IO_L03P_0
B13
I/O
0
IO_L04N_0
E11
I/O
0
IO_L04P_0
D11
I/O
0
IO_L05N_0/VREF_0
B11
VREF
0
IO_L05P_0
C11
I/O
0
IO_L06N_0
E10
I/O
0
IO_L06P_0
D10
I/O
0
IO_L08N_0/GCLK5
F9
GCLK
0
IO_L08P_0/GCLK4
E9
GCLK
0
IO_L09N_0/GCLK7
A9
GCLK
0
IO_L09P_0/GCLK6
A10
GCLK
0
IO_L11N_0/GCLK11
D8
GCLK
0
IO_L11P_0/GCLK10
C8
GCLK
0
IO_L12N_0
F8
I/O
相關(guān)PDF資料
PDF描述
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