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參數(shù)資料
| 型號： | UPD72042B |
| 廠商： | NEC Corp. |
| 英文描述： | LSI DEVICES FOR Inter Equipment BusTM (IEBusTM) PROTOCOL CONTROL |
| 中文描述： | LSI器件間設(shè)備BusTM（IEBusTM）協(xié)議控制 |
| 文件頁數(shù)： | 28/92頁 |
| 文件大小： | 541K |
| 代理商： | UPD72042B |
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μ
PD72042A, 72042B
28
DATA SHEET S13990EJ2V0DS00
(3) Data write mode
(a)
μ
PD72042A (starting with MSB)
C/D
SCK
SIO
Note
A3
A2
A1
A0
×
×
×
D7 D6
D5 D4
D3 D2
D1 D0
0
State
Control mode
(selection of register write)
Date write mode
Serial clock counter
reset pointer
(b)
μ
PD72042B (starting with LSB)
C/D
SCK
SIO
Note
A0
A1
A2
A3
×
×
×
D0 D1
D2 D3
D4 D5
D6 D7
0
State
Data write mode
Control mode
(selection of register write)
Serial clock counter
reset pointer
Note
SIO pin input state
Caution Register overwrite is started immediately after the eighth clock rising edge. All registers other
than TBF are overwritten at the eighth clock rising edge. (Data of less than eight clock periods
is ignored.)
相關(guān)PDF資料 |
PDF描述 |
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參數(shù)描述 |
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