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參數(shù)資料
| 型號： | UPD72042B |
| 廠商： | NEC Corp. |
| 英文描述： | LSI DEVICES FOR Inter Equipment BusTM (IEBusTM) PROTOCOL CONTROL |
| 中文描述： | LSI器件間設(shè)備BusTM（IEBusTM）協(xié)議控制 |
| 文件頁數(shù)： | 25/92頁 |
| 文件大?。?/td> | 541K |
| 代理商： | UPD72042B |
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μ
PD72042A, 72042B
25
DATA SHEET S13990EJ2V0DS00
(3) Data write mode
When the C/D pin is set low after register write has been selected in control mode, data write mode is set. In
data write mode, data for a write register is applied to the SI pin at the rising edge of the SCK pin.
(a)
μ
PD72042A (starting with MSB)
C/D
SCK
SI
A3
A2
A1
A0
×
×
×
D7 D6
D5 D4
D3 D2
D1 D0
SO
0
State
Control mode
(selection of register write)
Data write mode
Serial clock counter
reset pointer
“1”
(b)
μ
PD72042B (starting with LSB)
C/D
SCK
SI
A0
A1
A2
A3
×
×
×
D0 D1
D2 D3
D4 D5
D6 D7
SO
0
State
Control mode
(selection of register write)
Data write mode
Serial clock counter
reset pointer
“1”
Caution Register overwrite is started immediately after the eighth clock rising edge. All registers other
than TBF are overwritten on the eighth clock rising edge. (Data of less than eight clock periods
is ignored.)
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