參數(shù)資料
型號： TMS320LF2407APGEA
廠商： TEXAS INSTRUMENTS INC
元件分類： 數(shù)字信號處理
英文描述： 16-BIT, 20 MHz, OTHER DSP, PQFP144
封裝： GREEN, PLASTIC, LQFP-144
文件頁數(shù)： 128/134頁
文件大小： 1724K
代理商： TMS320LF2407APGEA
TMS320LF2407A, TMS320LF2406A, TMS320LF2403A, TMS320LF2402A
TMS320LC2406A, TMS320LC2404A, TMS320LC2403A, TMS320LC2402A
DSP CONTROLLERS
SPRS145L JULY 2000 REVISED SEPTEMBER 2007
POST OFFICE BOX 1443
HOUSTON, TEXAS 772511443
93
SPI
master
mode
external
timing
parameters
(clock
phase
=
1)
(see
Figure
43)
NO.
SPI
WHEN
(SPIBRR
+
1)
IS
EVEN
OR
SPIBRR
=
0
OR
2
SPI
WHEN
(SPIBRR
+
1)
IS
ODD
AND
SPIBRR
>
3
UNIT
NO.
MIN
MAX
MIN
MAX
UNIT
1
t c(SPC)M
Cycle
time,
SPICLK
4t
c(CO)
128t
c(CO)
5t
c(CO)
127t
c(CO)
ns
2
§
t w(SPCH)M
Pulse
duration,
SPICLK
high
(clock
polarity
=
0)
0.5t
c(SPC)M
10
0.5t
c(SPC)M
0.5t
c(SPC)M
0.5t
c(
C
O
)10
0.5t
c(SPC)M
0.5t
c(CO)
ns
2
§
t w(SPCL)M
Pulse
duration,
SPICLK
low
(clock
polarity
=
1)
0.5t
c(SPC)M
10
0.5t
c(SPC)M
0.5t
c(SPC)M
0.5t
c(
C
O
)10
0.5t
c(SPC)M
0.5t
c(CO)
ns
3
§
t w(SPCL)M
Pulse
duration,
SPICLK
low
(clock
polarity
=
0)
0.5t
c(SPC)M
10
0.5t
c(SPC)M
0.5t
c(SPC)M
+
0.5t
c(CO)
1
0
0.5t
c(SPC)M
+
0.5t
c(CO)
ns
3
§
t w(SPCH)M
Pulse
duration,
SPICLK
high
(clock
polarity
=
1)
0.5t
c(SPC)M
10
0.5t
c(SPC)M
0.5t
c(SPC)M
+
0.5t
c(CO)
10
0.5t
c(SPC)M
+
0.5t
c(CO)
ns
6
§
t su(SIMO-SPCH)M
Setup
time,
SPISIMO
data
valid
before
SPICLK
high
(clock
polarity
=
0)
0.5t
c(SPC)M
10
0.5t
c(SPC)M
1
0
ns
6
§
t su(SIMO-SPCL)M
Setup
time,
SPISIMO
data
valid
before
SPICLK
low
(clock
polarity
=
1)
0.5t
c(SPC)M
10
0.5t
c(SPC)M
1
0
ns
7
§
t v(SPCH-SIMO)M
V
alid
time,
SPISIMO
data
valid
after
SPICLK
high
(clock
polarity
=0)
0.5t
c(SPC)M
10
0.5t
c(SPC)M
1
0
ns
7
§
t v(SPCL-SIMO)M
V
alid
time,
SPISIMO
data
valid
after
SPICLK
low
(clock
polarity
=1)
0.5t
c(SPC)M
10
0.5t
c(SPC)M
10
ns
10
§
t su(SOMI-SPCH)M
Setup
time,
SPISOMI
before
SPICLK
high
(clock
polarity
=
0)
0
ns
10
§
t su(SOMI-SPCL)M
Setup
time,
SPISOMI
before
SPICLK
low
(clock
polarity
=
1)
0
ns
11
§
t v(SPCH-SOMI)M
V
alid
time,
SPISOMI
data
valid
after
SPICLK
high
(clock
polarity
=
0)
0.25t
c(SPC)M
10
0.5t
c(SPC)M
10
ns
11
§
t v(SPCL-SOMI)M
V
alid
time,
SPISOMI
data
valid
after
SPICLK
low
(clock
polarity
=
1)
0.25t
c(SPC)M
10
0.5t
c(SPC)M
10
ns
The
MASTER
/SLA
VE
bit
(SPICTL.2)
is
set
and
the
CLOCK
PHASE
bit
(SPICTL.3)
is
set.
t c
=
system
clock
cycle
time
=
1/CLKOUT
=
t
c(CO)
§
The
active
edge
of
the
SPICLK
signal
referenced
is
controlled
by
the
CLOCK
POLARITY
bit
(SPICCR.6).
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