參數(shù)資料
型號(hào)： TMS320LC542-50
元件分類(lèi)： 數(shù)字信號(hào)處理
英文描述： Digital Signal Processor
中文描述： 數(shù)字信號(hào)處理器
文件頁(yè)數(shù)： 102/111頁(yè)
文件大?。?/td> 1426K
代理商： TMS320LC542-50
TMS320C54x, TMS320LC54x, TMS320VC54x
FIXED-POINT DIGITAL SIGNAL PROCESSORS
SPRS039C – FEBRUARY 1996 – REVISED DECEMBER 1999
102
POST OFFICE BOX 1443
HOUSTON, TEXAS 77251–1443
host-port interface timing (continued)
timing requirements for host-port interface [H = 0.5t
c(CO)
] (see Note 5 and Figure 40 through
Figure 43)
’C54x-40
’C54x-50
’C54x-66
UNIT
MIN
MAX
tsu(HBV-DSL)
th(DSL-HBV)
tsu(HSL-DSL)
tw(DSL)
tw(DSH)
Setup time, HAD/HBIL valid before DS or HAS falling edge
10
ns
Hold time, HAD/HBIL valid after DS or HAS falling edge
5
ns
Setup time, HAS low before DS falling edge
12
30
ns
Pulse duration, DS low
ns
Pulse duration, DS high
10
ns
Cycle time DS rising edge to next DS
Cycle time, DS rising edge to next DS
rising edge
Case 1: HOM access timings
(see Access Timing Without HRDY)
50
tc(DSH-DSH)
Case 2a: SAM accesses and HOM active writes
to DSPINT or HINT.
(see Access Timings With HRDY)
10H
ns
tsu(HDV-DSH)
td(DSH-HSL)
th(DSH – HDV)W
A host not using HRDY should meet the 10H requirement all the time unless a software handshake is used to change the access rate according
to the HPI mode.
Must only be met if HAS is going low when not accessing the HPI (as would be the case where multiple devices are being driven by one host).
NOTE 5: SAM = shared-access mode, HOM = host-only mode
HAD stands for HCNTRL0, HCNTRL1, and HR/W.
HDS refers to either HDS1 or HDS2.
DS refers to the logical OR of HCS and HDS.
Setup time, HD valid before DS rising edge
12
ns
Delay time, DS high to next HAS low
10H
ns
Hold time, HD valid after DS rising edge, write
3
ns
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PDF描述
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參數(shù)描述
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