參數(shù)資料
型號(hào)： TMS320C10-25
廠商： Texas Instruments, Inc.
元件分類： 數(shù)字信號(hào)處理
英文描述： Digital Signal Processors(160ns指令周期，分離的程序和數(shù)據(jù)總線，外部輪詢中斷的DSP)
中文描述： 數(shù)字信號(hào)處理器（160ns指令周期，分離的程序和數(shù)據(jù)總線，外部輪詢中斷的數(shù)字信號(hào)處理器）
文件頁(yè)數(shù)： 71/139頁(yè)
文件大小： 1478K
代理商： TMS320C10-25
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TA = – 40
°
C to 85
°
C
TMS320LC15
DIGITAL SIGNAL PROCESSOR
SPRS009C–JANUARY 1987–REVISED JULY 1991
POST OFFICE BOX 1443
HOUSTON, TEXAS 77001
71
CLOCK CHARACTERISTICS AND TIMING
The
′
LC15 can use either its internal oscillator or an external frequency source for a clock.
internal clock option
The internal oscillator is enabled by connecting a crystal across X1 and X2/CLKIN (see Figure 1). The frequency
of CLKOUT is one-fourth the crystal fundamental frequency. The crystal should be fundamental mode, and
parallel resonant, with an effective series resistance of 30 ohms, a power dissipation of 1 mW, and be specified
at a load capacitance of 20 pF.
PARAMETER
TEST CONDITIONS
MIN
NOM
MAX
UNIT
Crystal frequency fx
C1, C2
4.0
16
MHz
10
pF
external clock option
An external frequency source can be used by injecting the frequency directly into X2/CLKIN with X1 left
unconnected. The external frequency injected must conform to the specifications listed in the table below.
switching characteristics over recommended operating conditions
PARAMETER
TEST CONDITIONS
MIN
NOM
MAX
UNIT
tc(C)
tr(C)
tf(C)
tw(CL)
tw(CH)
td(MCC)Delay time, CLKIN
↑
to CLKOUT
↓
CLKOUT cycle time
250
1000
ns
CLKOUT rise time
RL = 825
,
CL = 100 pF,
(see Figure 2)
10
8
117
115
ns
CLKOUT fall time
ns
Pulse duration, CLKOUT low
ns
Pulse duration, CLKOUT high
ns
20
70
ns
timing requirements over recommended operating conditions
MIN
NOM
MAX
UNIT
tc(MC)
tr(MC)
tf(MC)
tw(MCP)Pulse duration, master clock
tw(MCL)Pulse duration, master clock low at tc(MC) min
tw(MCH)Pulse duration, master clock high at tc(MC) min
tc(C) is the cycle time of CLKOUT, i.e., 4tc(MC) (4 times CLKIN cycle time if an external oscillator is used)
Values derived from characterization data and not tested.
Master clock cycle time
62.5
150
10
10
ns
Rise time, master clock input
5
5
ns
Fall time, master clock input
ns
0.4tc(MC)
0.6tc(MC)
26
ns
ns
26
ns
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PDF描述
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