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參數(shù)資料
| 型號(hào)： | TMP96C031 |
| 廠商： | Toshiba Corporation |
| 英文描述： | High Speed Advanced CMOS 16-bit Microcontroller For Controlling Medium to Large-Scale Equipment(用于中等到大型設(shè)備控制，高速、先進(jìn)的 CMOS 16位微控制器) |
| 中文描述： | 采用先進(jìn)的CMOS高速16位微控制器控制中的大型設(shè)備（用于中等到大型設(shè)備控制，高速，先進(jìn)的的CMOS 16位微控制器） |
| 文件頁數(shù)： | 108/186頁 |
| 文件大?。?/td> | 5299K |
| 代理商： | TMP96C031 |
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108
TOSHIBA CORPORATION
TMP96C031N/F
Note:
To shift PG, TFFCR <TFF1IE> must be set to “1” to enable TFF1 inversion.
Table 3.9 (1) Select of Trigger Signal
TFF1 Inversion
PG Shift
8-bit timer mode
Selected by TFFCR <TFF1IS> when the up-counter value matches
TREG0 or TREG1 value.
When the up-counter value matches with both TREG0 and TREG1
values. (The value of up-counter = TREG1*2
When the up-counter value matches with both TREG0 and TREG1.
When the up-counter value matches TREG0 value and PWM cycle.
16-bit timer mode
8
+ TREG0)
PPG output mode
PWM output mode
When the up-counter value matches TREG1 value (PPG cycle).
Trigger signal for PG is not generated.
Setting example: To drive channel 0 (PG0) by 4-phase 1-2
step excitation (normal rotation) when
timer 0 is selected, set each register as follows:
Note:
x; don’t care –; no change
7
–
0
x
*
1
–
1
1
6
x
0
x
*
0
–
1
x
5
–
x
x
*
1
–
0
–
4
–
x
0
*
0
–
0
–
3
–
–
1
*
1
0
1
–
2
–
–
0
*
0
0
0
–
1
–
0
1
*
1
1
0
–
0
0
1
0
*
0
1
0
1
TRUN
TMOD
TFFCR
TREG0
P6CRL
PG01CR
PG0REG
TRUN
←
←
←
←
←
←
←
←
Stop timer 0, and clears it to zero.
Set 8-bit timer mode and selects
Clear TFF1 to zero and enables the inversion trigger by timer 0.
Set the cycle in timer register.
Set P60 ~ P63 bits to PG output.
Select PG0 4-phase 1 - 2 step excitation mode and normal rotation.
Set an initial value.
Start timer 0.
φ
T1 as the input clock of timer 0.
(3)
Trigger Signal From Timer
The trigger signal from the timer which is used by PG is
Channel 1 of PG can be synchronized with the 16-bit
timer Timer 4. In this case, the PG shift trigger signal
from the 16-bit timer is output only when the up-
counter UC4 value matches TREG5.
When using a trigger signal from Timer 4, set either
T4FFCR <EQ5T4> or T4MOD <EQ5T5> to “1” and a
trigger is generated when the value in UC4 and the
value in TREG5 match.
not equal to the trigger signal of timer flip-flop (TFF1,
TFF4, TFF5, and TFF6) and differs as shown in Table
3.9 (1) depending on the operation mode of the timer.
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