參數(shù)資料
型號： STP1081ABGA-150
元件分類： 微控制器/微處理器
英文描述： SPECIALTY MICROPROCESSOR CIRCUIT, PBGA256
封裝： PLASTIC, BGA-256
文件頁數(shù)： 18/32頁
文件大?。?/td> 478K
代理商： STP1081ABGA-150
25
Companion Device for 250/300 MHz UltraSPARC-II Systems
UltraSPARC
-II Data Buffer (UDB-II)
STP1081
Preliminary
July 1997
1. These timing numbers are determined using tester loads. The actual spice netlists should be used to determine actual timing in the system being
designed.
2. Included for completeness only. These are initialization signals.
Input Setup and Hold Time Specications
[1]
Symbol
Parameter
Waveform
UDB-II for
150 MHz CPU
UDB-II for
300 MHz CPU
Unit
Min
Max
Min
Max
tsu
EDATA[63:0] setup time
1
-
1.59
-
1.35
ns
tsu
EDPAR[7:0] setup time
1
-
1.69
-
1.43
ns
tsu
CNTL[4:0] setup time
1
-
4.53
-
3.73
ns
tsu
SYSDATA[63:0] setup time
1
-
2.00
-
1.98
ns
tsu
SYSECC[7:0] setup time
1
-
2.00
-
1.98
ns
tsu
DATA_STALL setup time
1
-
1.41
-
1.58
ns
tsu
ECC_VALID setup time
1
-
1.48
-
1.38
ns
tsu
S_REPLY[3:0] setup time
1
-
1.48
-
1.38
ns
tsu
SYS_ID [4:0] setup time
1
-
4.78
-
4.28
ns
tsu
RESET_L setup time
1
-
[2]
--
ns
tsu
EPD setup time
1
-
-
ns
tsu
EXT_EVENT setup time
1
--
-ns
th
EDATA[63:0] hold time
1
1.27
-
1.30
-
ns
th
EDPAR[7:0] hold time
1
1.27
-
1.30
-
ns
th
CNTL[4:0]) hold time
1
0.18
-
0.18
-
ns
th
SYSDATA[63:0] hold time
1
1.04
-
0.95
-
ns
th
SYSECC[7:0] hold time
1
0.94
-
0.85
-
ns
th
DATA_STALL hold time
1
0.99
-
0.67
-
ns
th
ECC_VALID hold time
1
1.11
-
1.05
-
ns
th
S_REPLY[3:0] hold time
1
0.91
-
0.75
-
ns
th
SYS_ID[4:0] hold time
1
-0.20
-
-0.55
-
ns
th
RESET_L hold time
1
--
-ns
th
EPD hold time
1
--
-ns
th
EXT_EVENT hold time
1
--
-ns
相關PDF資料
PDF描述
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相關代理商/技術參數(shù)
參數(shù)描述
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