參數(shù)資料
型號(hào)： ST72E85A5G0
廠商： STMICROELECTRONICS
元件分類(lèi)： 微控制器/微處理器
英文描述： 8-BIT, UVPROM, 4.332 MHz, MICROCONTROLLER, CQFP80
封裝： WINDOWED, CERAMIC, QFP- 80
文件頁(yè)數(shù)： 85/117頁(yè)
文件大?。?/td> 748K
代理商： ST72E85A5G0
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7/117
ST7285C
Pin
Pin Name(s)
Basic Function
Alternate Fun ction
Remarks
1VSSP
Ground for Output Buff-
ers
-
This pin is connected to pin 41
2VDDP
Power Supply for Out-
put Buffers
This pin is connected to pin 42
3
OSCOUT
Oscillator Output pin.
4
OSCIN
Oscillator Input pin.
5
PC0/MISO_B
I/O Port PC0
SPI B master in/slave
out data input/output
Alternate function or I/O. The I/O configuration
is software selectable as triggered input or
push pull output.
6
PC1/MOSI_B
I/O Port PC1
SPI B Master Out/
Slave In Data Input/
Output
7
PC2/SCK_B
I/O Port PC2
SPI B Serial Clock
8
PC3/SS_B
I/O Port PC3
SPI B Slave Select
9
PC4/OC2_B
I/O Port PC4
Output Compare 2
on Timer B
Alternate function or I/O. Software selectable
as triggered input, push pull output, or trig-
gered interrupt input with pull up (Interrupt I10).
10
PC5/OC1_B
I/O Port PC5
Output Compare 1
on Timer B
11
PC6/IC2_B
I/O Port PC6
Input Capture 2
on Timer B
Alternate function or I/O. The I/O configuration
is software selectable as triggered input or
push pull output.
12
PC7/IC1_B
I/O Port PC7
Input Capture 1
on Timer B.
13
PD0/MISO_A
I/O Port PD0
SPI A Master In/Slave
Out Data Input/Output
14
PD1/MOSI_A
I/O Port PD1
SPI A Master Out/
Slave In data Input/
Output
15
PD2/SCK_A
I/O Port PD2
SPI A Serial Clock
16
PD3/SS_A
I/O Port PD3
SPI A Slave Select
17
PD4
I/O Port PD4
-
Software selectable as triggered input, push
pull output, open drain output or triggered in-
terrupt input with pull up (Interrupt I9).
18
PD5
I/O Port PD5
-
19
PD6/SCL
I/O Port PD6
I2C Serial Clock
Alternate function or I/O. The I/O configuration
is software selectable as triggered input or
open drain output.
20
PD7/SDA
I/O Port PD7
I2C Serial Data
21
RESET
General Reset
-
Bidirectional. An active low signal forces MCU
initialization. This event is the top priority non-
maskable interrupt. As an output, it can be
used to reset external peripherals.
22
TEST
RESERVED
-
Input. This pin MUST be tied directly to VSS
during normal operation.
23
VDD
Power Supply for all log-
ic circuitry
-
Except for output buffers and pull-ups.
24
VSS
Ground for all logic cir-
cuitry
-
25
PE0
I/O Port PE0
-
Software selectable as triggered input or push
pull output.
26
PE1
I/O Port PE1
-
27
PE2
I/O Port PE2
-
28
PE3
I/O Port PE3
-
29
PE4
I/O Port PE4
-
30
PE5
I/O Port PE5
-
31
PE6
I/O Port PE6
-
32
PE7
I/O Port PE7
-
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PDF描述
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