參數(shù)資料
型號: S5935QRC
廠商: APPLIEDMICRO INC
元件分類: 總線控制器
英文描述: PCI Product
中文描述: PCI BUS CONTROLLER, PQFP160
封裝: GREEN, PLASTIC, QFP-160
文件頁數(shù): 183/204頁
文件大?。?/td> 1897K
代理商: S5935QRC
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S5935 – PCI Product
Revision 1.02 – June 27, 2006
Data Book
AMCC Confidential and Proprietary
DS1527 183
Synchronous RD# FIFO Timing
Notes:
1. Data is valid for 22ns for a 31ns t124 RD# Setup.
2. RD# and SELECT# must both be asserted to dric=ve DQ[31:0] - delay is from the last one asserted.
3. When increasing Setup times, ADR[6:2], BE[3:0]#, SELECT#, and RD# timing relations remain relative to each other as shown.
4. Min and Max are indicated to allow increased valid data time as shown by dashed lines. First accesses are async.
Figure 100. Synchronous RD# FIFO Timing
Functional Operation Range (VCC=5.0V 5%, 0 C to 70 C T 50 pf load on outputs).
Symbol
Parameter
Min
Max
Units
Notes
t
112
SELECT# Setup to BPCLK Rising Edge
10
30
ns
4
t
112a
SELECT# Hold from BPCLK Rising Edge
2
ns
t
116
ADR[6:2] Setup to BPCLK Rising Edge
14
34
ns
4
t
116a
ADR[6:2] Hold from BPCLK Rising Edge
1
ns
t
120
BE[3:0]# Setup to BPCLK Rising Edge
9
29
ns
4
t
120a
BE[3:0]# Hold from BPCLK Rising Edge
3
ns
t
125
RD# Low to DQ[31:0] Driven
17
ns
1
t
128
RD# High to DQ[31:0] Float
8
ns
t
156
RDEMPTY Status Valid to BPCLK Rising Edge
13
ns
t
157
FRF Status Valid to BPCLK Rising Edge
74
ns
t
124
RD# Setup to BPCLK Rising Edge
11
31
ns
4
t
124a
RD# Hold from BPCLK Rising Edge
1
ns
t
127
DQ[31:0] Valid from BPCLK Rising Edge
6
ns
BPCLK
SELECT#
t
112
ADR[6:2]
BE[3:0]#
DQ[31:0]
RD#
t
116
t
120a
t
125
t
128
t
124a
t
112a
t
116a
t
120
t
124
RDEMPTY
FRF
5ns
t
156
t
157
t
112 Max
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PDF描述
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