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參數(shù)資料
| 型號： | S3C70F4XX-AV |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 4-BIT, MROM, 6 MHz, MICROCONTROLLER, PDIP30 |
| 封裝： | 0.400 INCH, SDIP-30 |
| 文件頁數(shù)： | 166/179頁 |
| 文件大?。?/td> | 1070K |
| 代理商： | S3C70F4XX-AV |
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OSCILLATOR CIRCUIT
S3C70F2/C70F4/P70F4
6–6
CLOCK OUTPUT CIRCUIT
The clock output circuit, used to output clock pulses to the CLO pin, has the following components:
— 4-bit clock output mode register (CLMOD)
— Clock selector
— Output latch
— Port mode flag
— CLO output pin (P3.2)
CLO
CLOCKS
4
(fx/8, fx/16, fx/64, CPU clock)
CLMOD.3
CLMOD.2
CLMOD.1
CLMOD.0
PM3.2
P3.2 OUTPUT LATCH
CLOCK
SELECTOR
Figure 6-4. CLO Output Pin Circuit Diagram
CLOCK OUTPUT PROCEDURE
To output clock pulses to the CLO pin, follow this general procedure:
1.
Disable clock output by clearing CLMOD.3 to logic zero.
2.
Set the clock output frequency (CLMOD.1, CLMOD.0).
3.
Load a "0" to the output latch of the CLO pin (P3.2).
4.
Set the P3.2 mode flag (PM3.2) to output mode.
5.
Enable clock output by setting CLMOD.3 to logic one.
+
+ PROGRAMMING TIP — CPU Clock Output to the CLO Pin
To output the CPU clock to the CLO pin:
BITS
EMB
; Or BITR EMB
SMB
15
LD
EA,#40H
LD
PMG1,EA
; P3.2
← Output mode
BITR
P3.2
; Clear P3.2 output latch
LD
A,#9H
LD
CLMOD,A
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