參數(shù)資料
型號： S3C70F4XX-AV
元件分類： 微控制器/微處理器
英文描述： 4-BIT, MROM, 6 MHz, MICROCONTROLLER, PDIP30
封裝： 0.400 INCH, SDIP-30
文件頁數(shù)： 165/179頁
文件大小： 1070K
代理商： S3C70F4XX-AV
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S3C70F2/C70F4/P70F4
OSCILLATOR CIRCUIT
6-5
INSTRUCTION CYCLE TIMES
The unit of time that equals one machine cycle varies depending on how the oscillator clock signal is divided (by
4, 8, or 64). Table 6-2 shows corresponding cycle times in microseconds.
Table 6-2. Instruction Cycle Times for CPU Clock Rates
Selected CPU Clock
Resulting Frequency
Oscillation Source
Cycle Time (sec)
fx/64
65.5 kHz
15.3
fx/8
524.0 kHz
fx = 4.19 MHz
1.91
fx/4
1.05 MHz
0.95
CLOCK OUTPUT MODE REGISTER (CLMOD)
The clock output mode register, CLMOD, is a 4-bit register that is used to enable or disable clock output to the
CLO pin and to select the CPU clock source and frequency. CLMOD is mapped to RAM address FD0H and is ad-
dressable by 4-bit write instructions only.
FD0H
CLMOD.3
"0"
CLMOD.1
CLMOD.0
RESET clears CLMOD to logic zero, which automatically selects the CPU clock as the clock source (without
initiating clock oscillation), and disables clock output.
CLMOD.3 is the enable/disable clock output control bit; CLMOD.1 and CLMOD.0 are used to select one of four
possible clock sources and frequencies: normal CPU clock, fx/8, fx/16, or fx/64.
Table 6-3. Clock Output Mode Register (CLMOD) Organization
CLMOD Bit Settings
Resulting Clock Output
CLMOD.1
CLMOD.0
Clock Source
Frequency
0
CPU clock (fx/4, fx/8, fx/64)
1.05 MHz, 524 kHz, 65.5 kHz
0
1
fx/8
524 kHz
1
0
fx/16
262 kHz
1
fx/64
65.5 kHz
CLMOD.3
Result of CLMOD.3 Setting
0
Clock output is disabled
1
Clock output is enabled
NOTE: Frequencies assume that fx = 4.19 MHz.
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