參數(shù)資料
型號(hào)： S3C70F2XX-SO
元件分類(lèi)： 微控制器/微處理器
英文描述： 4-BIT, MROM, 6 MHz, MICROCONTROLLER, PDSO32
封裝： 0.450 INCH, SOP-32
文件頁(yè)數(shù)： 177/179頁(yè)
文件大小： 1070K
代理商： S3C70F2XX-SO
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INTERRUPTS
S3C70F2/C70F4/P70F4
7-10
KEY INTERRUPT MODE REGISTER (IMODK)
The mode register for external interrupts at the KS0–KS2 pins, IMODK, is a 4-bit register at RAM address FB6H.
IMODK is addressable only by 4-bit write instructions.
RESET clears all IMODK bits to logic zero.
FB6H
"0"
IMODK.2
IMODK.1
IMODK.0
When bits in the IMODK register are set to logic one, INTK uses the falling edge of an incoming signal at
corresponding pins as the interrupt request trigger. When a falling edge is detected at any one of the pins KS0–
KS2, the IRQK flag is set to logic one and a release signal for power-down mode is generated.
Table 7-6. IMODK Register Bit Settings
IMODK
0
IMODK.2
IMODK.1
IMODK.0
Effect of IMODK Settings
0
Disable key interrupt
0
1
Select falling edge at KS0
0
1
0
Select falling edge at KS1
0
1
Select falling edge at KS0–KS1
1
0
Select falling edge at KS2
1
0
1
Select falling edge at KS0, KS2
1
0
Select falling edge at KS1–KS2
1
Select falling edge at KS0–KS2
KS2
KS1
KS0
FALLING
EDGE
DETECTION
CIRCUIT
1.
To generate a key interrupt on a falling edge at KS0–KS2, all KS0–KS2 pins must be configured
to input mode.
2.
If anyone of the KS0-KS2 pins used for interrupt stays low, a key interrupt is not generated.
Since all KS0-KS2 pins are ANDed, the falling edge detection circuit cannot detects a falling edge.
NOTES:
IRQK
IMODK
Figure 7-6. Circuit Diagram for KS0–KS2 Pins
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