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參數(shù)資料
| 型號： | R5F21388SDFPD |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 32-BIT, FLASH, 20 MHz, MICROCONTROLLER, PQFP80 |
| 封裝： | 12 X 12 MM, 0.50 MM PITCH, PLASTIC, LQFP-80 |
| 文件頁數(shù)： | 465/680頁 |
| 文件大?。?/td> | 6178K |
| 代理商： | R5F21388SDFPD |
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R8C/38T-A Group
21. Clock Synchronous Serial Interface
Under development Preliminary document
Specifications in this document are tentative and subject to change.
R01UH0241EJ0010 Rev.0.10
Page 486 of 730
Aug 05, 2011
21.3.2.4
Data Transmission/Reception
Data transmission/reception is an operation combining data transmission and reception, which were described
earlier.
Transmission/reception is started by writing data to the SITDR register. While the TDRE bit in the SISR
register is 1 (data is transferred from registers SITDR to SISDR), if the last transfer clock (the data transfer
length can be set from 8 to 16 bits using the SSBR register) rises or the ORER_AL bit in the SISR register is set
to 1 (overrun error), the transmit/receive operation is stopped.
When switching from transmit mode (TE_NAKIE = 1) or receive mode (RE_STIE = 1) to transmit/receive
mode (TE_NAKIE = RE_STIE = 1), set the TE_NAKIE bit in the SIER register to 0 and RE_STIE bit to 0 once
before making the change. After confirming that the TEND bit in the SISR register is 0 (the TDRE bit is 0 when
the last bit of transmit data is transmitted), the RDRF bit in the SISR register is 0 (no data in the SIRDR
register), and the ORER_AL bit in the SISR register is 0 (no overrun error), set bits TE_NAKIE and RE_STIE
to 1.
Figure 21.12 shows a Sample Flowchart for Data Transmission/Reception (Clock Synchronous Communication
When cancelling transmit/receive mode after this mode is used (TE_NAKIE = RE_STIE = 1), a clock may be
output if transmit/receive mode is cancelled after reading the SIRDR register. To avoid any clock outputs, use
either of the following procedures:
Set the RE_STIE bit to 0 and then set the TE_NAKIE bit to 0.
Set bits TE_NAKIE and RE_STIE to 0 at the same time.
When switching to receive mode (TE_NAKIE = 0 and RE_STIE = 1) after that, write 1 to the SIRST bit and
then set this bit to 0 to initialize the SSU control block and the SISDR register before setting the RE_STIE bit to
1.
相關PDF資料 |
PDF描述 |
|---|---|
| R5F2138ASDFPD | 32-BIT, FLASH, 20 MHz, MICROCONTROLLER, PQFP80 |
| R5F21388WJFP | MICROCONTROLLER, PQFP80 |
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| R5F21388HKFP | FLASH, 20 MHz, MICROCONTROLLER, PQFP80 |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
| R5F21388SNFP | 制造商:RENESAS 制造商全稱:Renesas Technology Corp 功能描述:RENESAS MCU |
| R5F21388WJFP | 制造商:RENESAS 制造商全稱:Renesas Technology Corp 功能描述:RENESAS MCU |
| R5F21388WKFP | 制造商:RENESAS 制造商全稱:Renesas Technology Corp 功能描述:RENESAS MCU |
| R5F21388XJFP | 制造商:RENESAS 制造商全稱:Renesas Technology Corp 功能描述:RENESAS MCU |
| R5F21388XKFP | 制造商:RENESAS 制造商全稱:Renesas Technology Corp 功能描述:RENESAS MCU |
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