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參數(shù)資料
| 型號(hào)： | R5F212CASDFP |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 8-BIT, FLASH, 20 MHz, MICROCONTROLLER, PQFP80 |
| 封裝： | 12 X 12 MM, 0.50 MM PITCH, PLASTIC, LQFP-80 |
| 文件頁(yè)數(shù)： | 213/615頁(yè) |
| 文件大?。?/td> | 6756K |
| 代理商： | R5F212CASDFP |
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R8C/2C Group, R8C/2D Group
14. Timers
Rev.2.00
Dec 05, 2007
Page 269 of 585
REJ09B0339-0200
Figure 14.85
Registers TRDSTR and TRDMR in Output Compare Function
Timer RD Mode Register
Symbol
Address
After Reset
TRDMR
0138h
00001110b
Bit Symbol
Bit Name
Function
RW
NOTE:
1. When selecting 0 (change the TRDGRji register output pin) by the IOj3 (j = C or D) bit in the TRDIORCi (i = 0 or 1)
register, set the BFji bit in the TRDMR register to 0.
RW
BFC1
BFD1
TRDGRD1 register function select
bit(1)
0 : General register
1 : Buffer register of TRDGRB1 register
RW
TRDGRC0 register function select
bit(1)
0 : General register
1 : Buffer register of TRDGRA0 register
BFC0
RW
TRDGRD0 register function select
bit(1)
0 : General register
1 : Buffer register of TRDGRB0 register
TRDGRC1 register function select
bit(1)
0 : General register
1 : Buffer register of TRDGRA1 register
RW
—
(b3-b1)
—
Timer RD synchronous bit
0 : Registers TRD0 and TRD1
operate independently
1 : Registers TRD0 and TRD1
operate synchronously
Nothing is assigned. If necessary, set to 0.
When read, the content is 1.
b7 b6 b5 b4 b3 b2
BFD0
b1 b0
SYNC
Timer RD Start Register(1)
Symbol
Address
After Reset
TRDSTR
0137h
11111100b
Bit Symbol
Bit Name
Function
RW
NOTES:
1.
2.
3.
4.
5.
Set the TRDSTR register using the MOV instruction (do not use the bit handling instruction). Refer to 14.4.12.1
TRDSTR Register of Notes on Tim er RD.
TRD0 count operation
select bit
0 : Count stops at the compare match w ith the
TRDGRA0 register
1 : Count continues after the compare match
w ith the TRDGRA0 register
CSEL0
RW
TRD1 count operation
select bit
0 : Count stops at the compare match w ith the
TRDGRA1 register
1 : Count continues after the compare match
w ith the TRDGRA1 register
—
(b7-b4)
RW
TSTART1
RW
TRD1 count start flag(5)
0 : Count stops(3)
1 : Count starts
TRD0 count start flag(4)
0 : Count stops(2)
1 : Count starts
Nothing is assigned. If necessary, set to 0.
When read, the content is 1.
b7 b6 b5 b4 b3 b2
CSEL1
b1 b0
TSTART0
When the CSEL0 bit is set to 1, w rite 0 to the TSTART0 bit.
When the CSEL1 bit is set to 1, w rite 0 to the TSTART1 bit.
When the CSEL0 bit is set to 0 and the compare match signal (TRDIOA0) is generated, this bit is set to 0 (count
stops).
When the CSEL1 bit is set to 0 and the compare match signal (TRDIOA1) is generated, this bit is set to 0 (count
stops).
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